参数资料
型号: SSTUAF32869AHLFT
厂商: IDT, Integrated Device Technology Inc
文件页数: 19/20页
文件大小: 0K
描述: IC REGIST BUFF 25BIT DDR2 150BGA
产品变化通告: Product Discontinuation 09/Dec/2011
标准包装: 2,000
逻辑类型: 1:2 可配置寄存缓冲器
电源电压: 1.7 V ~ 1.9 V
位数: 14
工作温度: 0°C ~ 70°C
安装类型: 表面贴装
封装/外壳: 150-TFBGA
供应商设备封装: 150-CABGA(8x13)
包装: 带卷 (TR)
ICSSSTUAF32869A
14-BIT CONFIGURABLE REGISTERED BUFFER FOR DDR2
COMMERCIAL TEMPERATURE GRADE
14-BIT CONFIGURABLE REGISTERED BUFFER FOR DDR2
8
ICSSSTUAF32869A
7095/14
Parity and Standby Function Table
Inputs1
Outputs
RESET
DCS
CSR
CLK
Σ of Inputs = H
(D1 - D14)2
PARIN3
PPO
PTYERR4
HL
X
↑↓
Even
L
H
HL
X
↑↓
Odd
L
H
L
HL
X
↑↓
Even
H
L
HL
X
↑↓
Odd
H
L
H
HL
L
↑↓
Even
L
H
HL
L
↑↓
Odd
L
H
L
HL
L
↑↓
Even
H
L
HL
L
↑↓
Odd
H
L
H
HH
H
↑↓
XX
PPOn0
PTYERRn0
H
X
L or H
X
PPOn0
PTYERRn0
LX or
Floating
X or
Floating
X or
Floating
X or
Floating
X or Floating
L
H
1
H = HIGH Voltage Level
L = LOW Voltage Level
X = Don’t Care
↑ = LOW to HIGH
↓ = HIGH to LOW
2
This range does not include D1, D4, and D7.
3
PARIN arrives one clock cycle (C1 = 0), or two clock cycles (C1 = 1), after the data to which it applies.
4
This transition assumes PTYERR is HIGH at the crossing of CLK going HIGH and CLK going LOW. If
PTYERR is LOW, it stays latched LOW for two clock cycles or until RESET is driven LOW. PARIN is used to
generate PPO and PTYERR.
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