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参数资料
| 型号： | ST62T00CM1 |
| 厂商： | STMICROELECTRONICS |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, OTPROM, 8 MHz, MICROCONTROLLER, PDSO16 |
| 封装： | 0.300 INCH, PLASTIC, SOP-16 |
| 文件页数： | 51/100页 |
| 文件大小： | 1713K |
| 代理商： | ST62T00CM1 |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页当前第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页
ST6200C ST6201C ST6203C
54/100
INSTRUCTION SET (Cont’d)
Arithmetic and Logic. These instructions are
used to perform arithmetic calculations and logic
operations. In AND, ADD, CP, SUB instructions
one operand is always the accumulator while, de-
pending on the addressing mode, the other can be
either a data space memory location or an imme-
diate value. In CLR, DEC, INC instructions the op-
erand can be any of the 256 data space address-
es. In COM, RLC, SLA the operand is always the
accumulator.
Table 16. Arithmetic & Logic Instructions
Notes:
X,Y
Index Registers
V, W Short Direct Registers
Δ
Affected
#
Immediate data (stored in ROM memory)
*
Not Affected
rr Data space register
Instruction
Addressing Mode
Bytes
Cycles
Flags
ZC
ADD A, (X)
Indirect
1
4
ΔΔ
ADD A, (Y)
Indirect
1
4
ΔΔ
ADD A, rr
Direct
2
4
ΔΔ
ADDI A, #N
Immediate
2
4
ΔΔ
AND A, (X)
Indirect
1
4
ΔΔ
AND A, (Y)
Indirect
1
4
ΔΔ
AND A, rr
Direct
2
4
ΔΔ
ANDI A, #N
Immediate
2
4
ΔΔ
CLR A
Short Direct
2
4
ΔΔ
CLR r
Direct
3
4
*
COM A
Inherent
1
4
ΔΔ
CP A, (X)
Indirect
1
4
ΔΔ
CP A, (Y)
Indirect
1
4
ΔΔ
CP A, rr
Direct
2
4
ΔΔ
CPI A, #N
Immediate
2
4
ΔΔ
DEC X
Short Direct
1
4
Δ
*
DEC Y
Short Direct
1
4
Δ
*
DEC V
Short Direct
1
4
Δ
*
DEC W
Short Direct
1
4
Δ
*
DEC A
Direct
2
4
Δ
*
DEC rr
Direct
2
4
Δ
*
DEC (X)
Indirect
1
4
Δ
*
DEC (Y)
Indirect
1
4
Δ
*
INC X
Short Direct
1
4
Δ
*
INC Y
Short Direct
1
4
Δ
*
INC V
Short Direct
1
4
Δ
*
INC W
Short Direct
1
4
Δ
*
INC A
Direct
2
4
Δ
*
INC rr
Direct
2
4
Δ
*
INC (X)
Indirect
1
4
Δ
*
INC (Y)
Indirect
1
4
Δ
*
RLC A
Inherent
1
4
ΔΔ
SLA A
Inherent
2
4
ΔΔ
SUB A, (X)
Indirect
1
4
ΔΔ
SUB A, (Y)
Indirect
1
4
ΔΔ
SUB A, rr
Direct
2
4
ΔΔ
SUBI A, #N
Immediate
2
4
ΔΔ
1
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