ST62T25CB6/XXX PDF资料下载(61/105 页)8-BIT, OTPROM, 8 MHz, MICROCONTROLLER, PDIP28

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参数资料

型号：	ST62T25CB6/XXX
厂商：	STMICROELECTRONICS
元件分类：	微控制器/微处理器
英文描述：	8-BIT, OTPROM, 8 MHz, MICROCONTROLLER, PDIP28
封装：	0.600 INCH, PLASTIC, DIP-28
文件页数：	61/105页
文件大小：	1003K
代理商：	ST62T25CB6/XXX

第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页当前第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页

ST6215C/ST6225C

59/105

INSTRUCTION SET (Cont’d)

Arithmetic and Logic. These instructions are

used to perform arithmetic calculations and logic

operations. In AND, ADD, CP, SUB instructions

one operand is always the accumulator while, de-

pending on the addressing mode, the other can be

either a data space memory location or an imme-

diate value. In CLR, DEC, INC instructions the op-

erand can be any of the 256 data space address-

es. In COM, RLC, SLA the operand is always the

accumulator.

Table 17. Arithmetic & Logic Instructions

Notes:

X,Y

Index Registers

V, W Short Direct Registers

Affected

#

Immediate data (stored in ROM memory)

*

Not Affected

rr Data space register

Instruction

Addressing Mode

Bytes

Cycles

Flags

ZC

ADD A, (X)

Indirect

1

4

ADD A, (Y)

Indirect

1

4

ADD A, rr

Direct

2

4

ADDI A, #N

Immediate

2

4

AND A, (X)

Indirect

1

4

AND A, (Y)

Indirect

1

4

AND A, rr

Direct

2

4

ANDI A, #N

Immediate

2

4

CLR A

Short Direct

2

4

CLR r

Direct

3

4

*

COM A

Inherent

1

4

CP A, (X)

Indirect

1

4

CP A, (Y)

Indirect

1

4

CP A, rr

Direct

2

4

CPI A, #N

Immediate

2

4

DEC X

Short Direct

1

4

*

DEC Y

Short Direct

1

4

*

DEC V

Short Direct

1

4

*

DEC W

Short Direct

1

4

*

DEC A

Direct

2

4

*

DEC rr

Direct

2

4

*

DEC (X)

Indirect

1

4

*

DEC (Y)

Indirect

1

4

*

INC X

Short Direct

1

4

*

INC Y

Short Direct

1

4

*

INC V

Short Direct

1

4

*

INC W

Short Direct

1

4

*

INC A

Direct

2

4

*

INC rr

Direct

2

4

*

INC (X)

Indirect

1

4

*

INC (Y)

Indirect

1

4

*

RLC A

Inherent

1

4

SLA A

Inherent

2

4

SUB A, (X)

Indirect

1

4

SUB A, (Y)

Indirect

1

4

SUB A, rr

Direct

2

4

SUBI A, #N

Immediate

2

4

1

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