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参数资料
| 型号： | ST72C334N4B3XXX |
| 厂商： | STMICROELECTRONICS |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, FLASH, 8 MHz, MICROCONTROLLER, PDIP56 |
| 封装： | 0.600 INCH, PLASTIC, SDIP-56 |
| 文件页数： | 117/153页 |
| 文件大小： | 2235K |
| 代理商： | ST72C334N4B3XXX |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页当前第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页第151页第152页第153页
ST72334J/N, ST72314J/N, ST72124J
66/153
16-BIT TIMER (Cont’d)
14.3.4 Low Power Modes
14.3.5 Interrupts
Note: The 16-bit Timer interrupt events are connected to the same interrupt vector (see Interrupts chap-
ter). These events generate an interrupt if the corresponding Enable Control Bit is set and the interrupt
mask in the CC register is reset (RIM instruction).
14.3.6 Summary of Timer modes
1) See note 4 in Section 14.3.3.5 "One Pulse Mode" on page 63
2) See note 5 in Section 14.3.3.5 "One Pulse Mode" on page 63
3) See note 4 in Section 14.3.3.6 "Pulse Width Modulation Mode" on page 65
Mode
Description
WAIT
No effect on 16-bit Timer.
Timer interrupts cause the device to exit from WAIT mode.
HALT
16-bit Timer registers are frozen.
In HALT mode, the counter stops counting until Halt mode is exited. Counting resumes from the previous
count when the MCU is woken up by an interrupt with “exit from HALT mode” capability or from the counter
reset value when the MCU is woken up by a RESET.
If an input capture event occurs on the ICAP
i pin, the input capture detection circuitry is armed. Consequent-
ly, when the MCU is woken up by an interrupt with “exit from HALT mode” capability, the ICF
i bit is set, and
the counter value present when exiting from HALT mode is captured into the IC
iR register.
Interrupt Event
Event
Flag
Enable
Control
Bit
Exit
from
Wait
Exit
from
Halt
Input Capture 1 event/Counter reset in PWM mode
ICF1
ICIE
Yes
No
Input Capture 2 event
ICF2
Yes
No
Output Compare 1 event (not available in PWM mode)
OCF1
OCIE
Yes
No
Output Compare 2 event (not available in PWM mode)
OCF2
Yes
No
Timer Overflow event
TOF
TOIE
Yes
No
MODES
AVAILABLE RESOURCES
Input Capture 1
Input Capture 2
Output Compare 1 Output Compare 2
Input Capture (1 and/or 2)
Yes
Output Compare (1 and/or 2)
Yes
One Pulse mode
No
Not Recommended1)
No
Partially 2)
PWM Mode
No
Not Recommended3)
No
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