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参数资料
| 型号： | ST72C334N4B3XXX |
| 厂商： | STMICROELECTRONICS |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, FLASH, 8 MHz, MICROCONTROLLER, PDIP56 |
| 封装： | 0.600 INCH, PLASTIC, SDIP-56 |
| 文件页数： | 51/153页 |
| 文件大小： | 2235K |
| 代理商： | ST72C334N4B3XXX |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页当前第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页第151页第152页第153页
ST72334J/N, ST72314J/N, ST72124J
144/153
18 DEVICE CONFIGURATION AND ORDERING INFORMATION
Each device is available for production in user pro-
grammable versions (FLASH) as well as in factory
coded versions (ROM). E2PROM data memory
and FLASH devices are shipped to customers with
a default content (FFh), while ROM factory coded
parts contain the code supplied by the customer.
This implies that FLASH devices have to be con-
figured by the customer using the Option Bytes
while the ROM devices are factory-configured.
18.1 OPTION BYTES
The two option bytes allow the hardware configu-
ration of the microcontroller to be selected.
The option bytes have no address in the memory
map and can be accessed only in programming
mode (for example using a standard ST7 program-
ming tool). The default content of the FLASH is
fixed to FFh.
In masked ROM devices, the option bytes are
fixed in hardware by the ROM code (see option
list).
USER OPTION BYTE 0
Bit 7:2 = Reserved, must always be 1.
Bit 1 = 56/42
Package Configuration.
This option bit allows to configured the device ac-
cording to the package.
0: 42 or 44 pin packages
1: 56 or 64 pin packages
Bit 0 = FMP
Full memory protection.
This option bit enables or disables external access
to the internal program memory (read-out protec-
tion). Clearing this bit causes the erasing (by over-
writing with the currently latched values) of the
whole memory (not including the option bytes).
0: Program memory not read-out protected
1: Program memory read-out protected
Note: The data E2PROM is not protected by this
bit in flash devices. In ROM devices, a protection
can be selected in the Option List (see page 146).
USER OPTION BYTE 1
Bit 7 = CSS
Clock Security System disable
This option bit enables or disables the CSS fea-
tures.
0: CSS enabled
1: CSS disabled
Bit 6:4 = OSC[2:0]
Oscillator selection
These three option bits can be used to select the
main oscillator as shown in Table 24.
Bit 3:2 = LVD[1:0]
Low voltage detection selection
These option bits enable the LVD block with a se-
lected threshold as shown in Table 25.
Bit 1 = WDG HALT
Watchdog Reset on HALTt
mode
This option bit determines if a RESET is generated
when entering HALT mode while the Watchdog is
active.
0: No Reset generation when entering Halt mode
1: Reset generation when entering Halt mode
Bit 0 = WDG SW
Hardware or software watchdog
This option bit selects the watchdog type.
0: Hardware (watchdog always enabled)
1: Software (watchdog to be enabled by software)
Table 24. Main Oscillator Configuration
Table 25. LVD Threshold Configuration
Selected Oscillator
OSC2 OSC1 OSC0
External Clock (Stand-by)
11
1
~4 MHz Internal RC
11
0
1~14 MHz External RC
10
X
Low Power Resonator (LP)
01
1
Medium Power Resonator (MP)
01
0
Medium Speed Resonator (MS)
00
1
High Speed Resonator (HS)
00
0
Configuration
LVD1 LVD0
LVD Off
11
Highest Voltage Threshold (
4.50V)
10
Medium Voltage Threshold (
4.05V)
01
Lowest Voltage Threshold (
3.45V)
00
USER OPTION BYTE 0
70
USER OPTION BYTE 1
70
Reserved
56/42 FMP
CSS
OSC
2
OSC
1
OSC
0
LVD1 LVD0
WDG
HALT
WDG
SW
Default
Value
111111
X
0
1
1101
111
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PDF描述 |
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