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参数资料
| 型号： | ST72F324K2B6 |
| 厂商： | STMICROELECTRONICS |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, FLASH, 8 MHz, MICROCONTROLLER, PDIP32 |
| 封装： | 0.400 INCH, PLASTIC, SDIP-32 |
| 文件页数： | 32/156页 |
| 文件大小： | 1027K |
| 代理商： | ST72F324K2B6 |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页当前第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页第151页第152页第153页第154页第155页第156页
ST72324J/K
127/156
CLOCK CHARACTERISTICS (Cont’d)
12.5.5 Clock Security System (CSS)
Note:
1. Data based on characterization results.
12.5.6 PLL Characteristics
Operating conditions: VDD 3.8 to 5.5V @ TA 0to 70°C
1) or V
DD 4.5 to 5.5V @ TA -40 to 125°C
Note:
1. Data characterized but not tested.
Figure 72. PLL Jitter vs. Signal frequency1
The user must take the PLL jitter into account in
the application (for example in serial communica-
tion or sampling of high frequency signals). The
PLL jitter is a periodic effect, which is integrated
over several CPU cycles. Therefore the longer the
period of the application signal, the less it will be
impacted by the PLL jitter.
Figure 72 shows the PLL jitter integrated on appli-
cation signals in the range 125kHz to 2MHz. At fre-
quencies of less than 125KHz, the jitter is negligi-
ble.
Note 1: Measurement conditions: fCPU = 4MHz, TA=25°C
Symbol
Parameter
Conditions
Min
Typ
Max
Unit
fSFOSC
Safe Oscillator Frequency 1)
3
MHz
Symbol
Parameter
Conditions
Min
Typ
Max
Unit
VDD(PLL)
PLL Operating Range
TA 0to 70°C
3.8
5.5
V
TA -40 to +125°C
4.5
5.5
fOSC
PLL input frequency range
2
4
MHz
fCPU/ fCPU
Instantaneous PLL jitter 1)
fOSC = 4 MHz.
1.0
2.5
%
fOSC = 2 MHz.
2.5
4.0
%
0
0.1
0.2
0.3
0.4
0.5
0.6
0.7
0.8
2000
1000
500
250
125
Application Signal Frequency (KHz)
+/-Jitter
(%)
PLL ON
PLL OFF
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