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参数资料
| 型号： | ST72T141K2M6XXX |
| 厂商： | STMICROELECTRONICS |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, OTPROM, 8 MHz, MICROCONTROLLER, PDSO34 |
| 封装： | 0.300 INCH, PLASTIC, SO-34 |
| 文件页数： | 26/132页 |
| 文件大小： | 1494K |
| 代理商： | ST72T141K2M6XXX |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页当前第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页
ST72141K
121/132
10.6 SUPPLY, RESET AND CLOCK CHARACTERISTICS
10.6.1 Supply Manager
Recommended operating conditions with TA=-40 to +125
oC and voltages referred to V
SS.
10.6.2 RESET Sequence Manager
Recommended operating conditions with TA=-40...+125
oC and 4.5V<V
DD-VSS<5.5V.
10.6.3 Clock System
Recommended operating conditions with TA=-40 to +125
oC and voltages referred to V
SS.
Notes:
1) LVD typical data is based on TA=25°C. This data is provided only as design guidelines and are not tested.
2) The VLVDhyst hysteresis is constant.
3) The VDD rise time rate condition is needed to ensure a correct device power-on reset. Not tested in production.
4) Data based on characterization results, not tested in production.
5) Unless otherwise specified, typical data is based on TA=25°C and VDD-VSS=5V. This data is provided only as design
guidelines and is not tested.
6) This data is based on typical a RSmax value. The oscillator selection can be optimized in terms of supply current with
a high quality resonator.
7) RSmax is the equivalent serial resistor of the crystal or ceramic resonator.
8) Data based on design simulations and/or technology characteristics, not tested in production.
LOW VOLTAGE DETECTOR (LVD)
Symbol
Parameter
Conditions
Min
Typ 1)
Max
Unit
VLVDr
Reset release threshold
VDD rise
4.05
4.30
V
VLVDf
Reset generation threshold
VDD fall
3.5
3.75
4.0
VLVDhyst
VLVD Hysteresis
2)
VLVDr - VLVDf
250
mV
VtPOR
VDD rise time rate
3)
0.2
50
V/ms
IDD
LVD Supply Current
HALT mode
100
2004)
A
RESET SEQUENCE MANAGER (RSM)
Symbol
Parameter
Conditions
Min
Typ 5)
Max
Unit
RON
Reset weak pull-up resistance
VIN > VIH
VIN ≥VSS
5
20
10
80
20
180
k
tDELAYmin
Reset delay for external and
watchdog reset sources
6
30
1/fSFOSC
s
tPULSE
External RESET pin Pulse time
20
s
EXTERNAL CLOCK SOURCE
Symbol
Parameter
Conditions
Min
Typ
Max
Unit
VOSC2h
OSC2 input pin high level voltage
Square wave signal
with ~50% Duty Cycle
0.7xVDD
VDD
V
VOSC2l
OSC2 input pin low level voltage
VSS
0.3xVDD
CRYSTAL AND CERAMIC RESONATOR OSCILLATORS
Symbol
Parameter
Conditions
Min
Typ 5)
Max
Unit
fOSC
Oscillator Frequency 6)
816
MHz
CLi
Load Capacitor
RSmax=100
7)
15 8)
18
21 6)
pF
IDD
Supply Current
700
1100 4)
A
tSTART
Oscillator start-up time
Depends on resonator quality. A typical value is 10ms
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PDF描述 |
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