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参数资料
| 型号： | ST72T671N4B1XXX |
| 厂商： | STMICROELECTRONICS |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, OTPROM, 8 MHz, MICROCONTROLLER, PDIP56 |
| 封装： | 0.600 INCH, SHRINK, PLASTIC, DIP-56 |
| 文件页数： | 10/101页 |
| 文件大小： | 608K |
| 代理商： | ST72T671N4B1XXX |
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ST72671
RESET (Cont’d)
Table 5. List of sections affected by RESET, WAIT and HALT (Refer to 3.6 for Wait and Halt Modes)
Figure 10. Reset Timing Diagram
Note: Refer to Electrical Characteristics for values of tDDR and tOXOV
Section
RESET
WAIT
HALT
CPU clock running at 4 MHz
X
Timer Prescaler reset to zero
X
Timer Counter set to FFFCh
X
All Timer enable bits set to 0 (disabled)
X
Data Direction Registers set to 0 (as Inputs)
X
Set Stack Pointer to 01FFh
X
Force Internal Address Bus to restart vector FFFEh, FFFFh
X
Set Interrupt Mask Bit (I-Bit, CC) to 1 (Interrupt disable)
X
Set Interrupt Mask Bit (I-Bit, CC) to 0 (Interrupt enable)
X
Reset HALT latch
X
Reset WAIT latch
X
Disable Oscillator (for 4096 cycles)
X
Set Timer Clock to 0
X
Watchdog counter reset
X
Watchdog register reset
X
Port data registers reset
X
Other on-chip peripherals: registers reset
X
VDD
OSCIN
fCPU
FFFF
FFFE
PC
RESET
WATCHDOG RESET
tDDR
tOXOV
4096 CPU
CLOCK
CYCLES
DELAY
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PDF描述 |
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