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参数资料
| 型号： | ST7L35UC/XXXX |
| 厂商： | STMICROELECTRONICS |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, MROM, 8 MHz, MICROCONTROLLER, QCC20 |
| 封装： | 5 X 6 MM, ROHS COMPLIANT, QFN-20 |
| 文件页数： | 227/236页 |
| 文件大小： | 2064K |
| 代理商： | ST7L35UC/XXXX |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页第151页第152页第153页第154页第155页第156页第157页第158页第159页第160页第161页第162页第163页第164页第165页第166页第167页第168页第169页第170页第171页第172页第173页第174页第175页第176页第177页第178页第179页第180页第181页第182页第183页第184页第185页第186页第187页第188页第189页第190页第191页第192页第193页第194页第195页第196页第197页第198页第199页第200页第201页第202页第203页第204页第205页第206页第207页第208页第209页第210页第211页第212页第213页第214页第215页第216页第217页第218页第219页第220页第221页第222页第223页第224页第225页第226页当前第227页第228页第229页第230页第231页第232页第233页第234页第235页第236页
On-chip peripherals
ST7L34, ST7L35, ST7L38, ST7L39
Doc ID 11928 Rev 7
11.2.5
Interrupts
11.2.6
Register description
Timer control status register (ATCSR)
Active halt
AT timer halted except if CK0 = 1, CK1 = 0 and OVFIE = 1
Halt
AT timer halted
Table 34.
Effect of low power modes on AT3 timer (continued)
Table 35.
AT3 interrupt control/wake-up capability
Interrupt
event(1)
1.
The CMP and AT3 IC events are connected to the same interrupt vector. The OVF event is mapped on a
separate vector (see Section 8: Interrupts). They generate an interrupt if the enable bit is set in the ATCSR
register and the interrupt mask in the CC register is reset (RIM instruction).
Event
flag
Enable
control bit
Exit
from wait
Exit
from Halt
Exit from
active halt
Overflow event
OVF1
OVFIE1
Yes
No
Yes(2)
2.
Only if CK0 = 1 and CK1 = 0 (fCOUNTER = fLTIMER)
AT3 IC event
ICF
ICIE
No
CMP event
CMPFx
CMPIE
ATCSR
Reset value: 0x00 0000 (x0h)
76
543
21
0
Reserved
ICF
ICIE
CK[1:0]
OVF1
OVFIE1
CMPIE
-
R/W
Table 36.
ATCSR register description
Bit
Bit name
Function
7
-
Reserved, must be kept cleared
6ICF
Input capture flag
This bit is set by hardware and cleared by software by reading the
ATICR register (a read access to ATICRH or ATICRL clears this flag).
Writing to this bit does not change the bit value.
0: No input capture
1: An input capture has occurred
5ICIE
IC interrupt enable
This bit is set and cleared by software.
0: Input capture interrupt disabled
1: Input capture interrupt enabled
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