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参数资料
| 型号： | STM8AF52AATBU |
| 厂商： | STMICROELECTRONICS |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, FLASH, 24 MHz, MICROCONTROLLER, PQFP80 |
| 封装： | 14 X 14 MM, ROHS COMPLIANT, LQFP-80 |
| 文件页数： | 53/120页 |
| 文件大小： | 2236K |
| 代理商： | STM8AF52AATBU |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页当前第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页
Memory and register map
STM8AF52/62xx, STM8AF51/61xx
Doc ID 14395 Rev 7
7.2
Register map
In this section the memory and register map of the devices covered by this datasheet is
described. For a detailed description of the functionality of the registers, refer to the
reference manual RM009.
7.2.1
I/O register map
Table 11.
I/O port hardware register map
Address
Block
Register label
Register name
Reset
status
00 5000h
Port A
PA_ODR
Port A data output latch register
00h
00 5001h
PA_IDR
Port A input pin value register
00h
00 5002h
PA_DDR
Port A data direction register
00h
00 5003h
PA_CR1
Port A control register 1
00h
00 5004h
PA_CR2
Port A control register 2
00h
00 5005h
Port B
PB_ODR
Port B data output latch register
00h
00 5006h
PB_IDR
Port B input pin value register
00h
00 5007h
PB_DDR
Port B data direction register
00h
00 5008h
PB_CR1
Port B control register 1
00h
00 5009h
PB_CR2
Port B control register 2
00h
00 500Ah
Port C
PC_ODR
Port C data output latch register
00h
00 500Bh
PB_IDR
Port C input pin value register
00h
00 500Ch
PC_DDR
Port C data direction register
00h
00 500Dh
PC_CR1
Port C control register 1
00h
00 500Eh
PC_CR2
Port C control register 2
00h
00 500Fh
Port D
PD_ODR
Port D data output latch register
00h
00 5010h
PD_IDR
Port D input pin value register
00h
00 5011h
PD_DDR
Port D data direction register
00h
00 5012h
PD_CR1
Port D control register 1
02h
00 5013h
PD_CR2
Port D control register 2
00h
00 5014h
Port E
PE_ODR
Port E data output latch register
00h
00 5015h
PE_IDR
Port E input pin value register
00h
00 5016h
PE_DDR
Port E data direction register
00h
00 5017h
PE_CR1
Port E control register 1
00h
00 5018h
PE_CR2
Port E control register 2
00h
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