参数资料
| 型号： | SY10EL34LZG |
| 厂商： | Micrel Inc |
| 文件页数： | 6/7页 |
| 文件大小： | 0K |
| 描述： | IC CLK GEN /2/4/8 3.3/5V 16-SOIC |
| 标准包装： | 48 |
| 系列： | 10EL, Precision Edge® |
| 类型： | 时钟发生器 |
| PLL： | 无 |
| 输入： | ECL，PECL |
| 输出： | 时钟 |
| 电路数： | 1 |
| 比率 - 输入:输出： | 1:3 |
| 差分 - 输入:输出： | 是/是 |
| 除法器/乘法器： | 是/无 |
| 电源电压： | 3 V ~ 3.8 V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 16-SOIC（0.154"，3.90mm 宽） |
| 供应商设备封装： | 16-SOIC |
| 包装： | 管件 |
| 产品目录页面： | 1086 (CN2011-ZH PDF) |
| 其它名称： | 576-2027-5 SY10EL34LZG-ND |
Micrel, Inc.
Precision Edge
SY10EL34/L
SY100EL34/L
December 2011
7
M9999-120611-I
hbwhelp@micrel.com or (408) 955-1690
Timing Diagram
The EN signal will freeze the internal clocks to the flip-flops on the first falling edge of CLK after its assertion. The internal
dividers will maintain their state during the internal clock freeze and will return to clocking once the internal clocks are
unfrozen. The outputs will transition to their next states in the same manner, time and relationship as they would have had
the EN signal not been asserted.
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PDF描述 |
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相关代理商/技术参数 |
参数描述 |
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