参数资料
| 型号： | SY10EP451LTG TR |
| 厂商： | Micrel Inc |
| 文件页数： | 1/10页 |
| 文件大小： | 0K |
| 描述： | IC REGISTER DIFF ECL 3.3V 32TQFP |
| 标准包装： | 1,000 |
| 系列： | 10EP |
| 功能： | 主复位 |
| 类型： | D 型总线 |
| 输出类型： | 差分 |
| 元件数： | 1 |
| 每个元件的位元数： | 6 |
| 触发器类型： | 正边沿 |
| 电源电压： | 3 V ~ 3.6 V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 32-TQFP |
| 包装： | 带卷 (TR) |
SY10/100EP451L
3.3V ECL 6-Bit Differential Register
with Master Reset
Micrel Inc. 2180 Fortune Drive San Jose, CA 95131 USA tel +1 (
408) 944-0800 fax + 1 (408) 474-1000 http://www.micrel.com
May 2007
M9999-051807-B
hbwhelp@micrel.com or (408) 955-1690
General Description
The SY10/100EP451L is a 6-bit fully differential register
with common clock and single-ended Master Reset (MR).
It is ideal for very high frequency applications where a
registered data path is necessary.
All inputs have an internal 75k pull-down resistor.
Differential inputs have an override clamp. Unused
differential register inputs can be left open and will default
LOW. When the differential inputs are forced to a value
smaller than VEE +1.2V, the clamp will override and force
the output to a default state.
The positive transition of CLK (pin 4) will latch the
registers. Master Reset (MR) HIGH will asynchronously
reset all registers forcing Q outputs to go LOW.
Datasheets and support documentation can be found on
Micrel’s web site at: www.micrel.com.
Features
450ps typical propagation delay
Maximum frequency > 3.0GHz typical
Asynchronous Master Reset
20ps skew within device, 35ps skew device-to-device
PECL mode operating range:
– VCC = 3.0V to 3.6V with VEE = 0V
NECL mode operating range:
– VCC = 0V with VEE = –3.0V to –3.6V
Open input default state
Safety clamp on inputs
Available in 32-pin TQFP
Applications
High Speed Logic
Wireless Communication Systems
Data Communication Systems
相关PDF资料 |
PDF描述 |
|---|---|
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| SY100E451JY | IC DATA CLOCK 6BIT DIFF 28-PLCC |
| SY10E151JY | IC REGISTER 6BIT D 28-PLCC |
| SY10E451JY TR | IC DATA CLOCK 6BIT DIFF 28-PLCC |
相关代理商/技术参数 |
参数描述 |
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