参数资料
| 型号： | SY10EP451LTG TR |
| 厂商： | Micrel Inc |
| 文件页数： | 5/10页 |
| 文件大小： | 0K |
| 描述： | IC REGISTER DIFF ECL 3.3V 32TQFP |
| 标准包装： | 1,000 |
| 系列： | 10EP |
| 功能： | 主复位 |
| 类型： | D 型总线 |
| 输出类型： | 差分 |
| 元件数： | 1 |
| 每个元件的位元数： | 6 |
| 触发器类型： | 正边沿 |
| 电源电压： | 3 V ~ 3.6 V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 32-TQFP |
| 包装： | 带卷 (TR) |
Micrel, Inc.
SY10/100EP451L
May 2007
4
M9999-051807-B
hbwhelp@micrel.com or (408) 955-1690
Pin Description
Pin Number
Pin Name
Pin Function
2, 3
32, 1
30, 31
26, 27
24, 25
22, 23
D0, /D0
D1, /D1
D2, /D2
D3, /D3
D4, /D4
D5, /D5
ECL Differential Data Inputs: These input pairs are the different data signal inputs to the
device. Each input pin is connected to a 75k pull-down resistor. Due to an internal
clamping circuit, D will default LOW and /D will default HIGH if left open.
29
MR
ECL Master Reset Input pin. If input pin is left open, it will default to LOW.
4, 5
CLK, /CLK
ECL Differential Clock Input: This input pair is the clock signal input to the device. Each
input pin is connected to a 75k pull-down resistor. Due to an internal clamping circuit,
CLK will default LOW and /CLK will default HIGH if left open.
7, 8
9, 10
11, 12
14, 15
17, 18
20, 21
Q0, /Q0
Q1, /Q1
Q2, /Q2
Q3, /Q3
Q4, /Q4
Q5, /Q5
ECL Differential Data Outputs: Q defaults to LOW and /Q defaults to HIGH if D inputs are
left open. See “LVPECL Output Interface Applications” section for recommendations on
terminations.
6, 13, 16
VCC
Positive Supply: Bypass with 0.1F||0.01F low ESR capacitors as close to the VCC pins
as possible.
19, 28
VEE
Negative Power Supply: VEE must be tied to most negative supply.
相关PDF资料 |
PDF描述 |
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| SY10E151JY | IC REGISTER 6BIT D 28-PLCC |
| SY10E451JY TR | IC DATA CLOCK 6BIT DIFF 28-PLCC |
相关代理商/技术参数 |
参数描述 |
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