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参数资料
| 型号： | TC35273 |
| 元件分类： | 消费家电 |
| 英文描述： | SPECIALTY CONSUMER CIRCUIT, PBGA201 |
| 封装： | 15 X 15 MM, PLASTIC, FBGA-201 |
| 文件页数： | 11/23页 |
| 文件大小： | 237K |
| 代理商： | TC35273 |
MPEG-4 Audiovisual Codec LSI
Preliminary
TC35273
TOSHIBA Confidential
2000-4-27
19/23
Version 0.90
Fig. 14 Audio ADC&DAC Interface (Master clock output mode).
Table 15 Audio ADC&DAC Interface Timing (Master clock output mode).
Parameter
Description
Min
Max
Unit
Clock cycle period of ADOMCLK.
80
ns
TMCKW
Duty ratio of ADOMCLK.
50+/-10
%
Clock cycle period of ADSCLK.
TMCKW
*8
ns
TSCKW
Delay time from ADOMCLK to ADKCLK.
TSYSCLK
*2
ns
TSDIS
Setup time of ADSDI.
TSYSCLK
*1
ns
TSDIH
Hold time of ADSDI.
TSYSCLK
*4
ns
TLCKD
Delay time from ADSCLK to ADLRLCK.
TSYSCLK
*1
ns
TSDOD
Delay time from ADSCLK to ADSDO.
TSYSCLK
*6
ns
ASCLK
ALRCK
ASDTI
ASDTO
15
16 Clock Cycles
14
13
12
11
1
0
15
14
13
12
11
1
0
15
14
13
Rch Data
Lch Data
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PDF描述 |
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参数描述 |
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