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参数资料
| 型号： | THS1206IDARG4 |
| 厂商： | TEXAS INSTRUMENTS INC |
| 元件分类： | ADC |
| 英文描述： | 4-CH 12-BIT PROPRIETARY METHOD ADC, PARALLEL ACCESS, PDSO32 |
| 封装： | GREEN, PLASTIC, TSSOP-32 |
| 文件页数： | 27/43页 |
| 文件大小： | 722K |
| 代理商： | THS1206IDARG4 |
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THS1206
SLAS217H – MAY 1999 – REVISED JULY 2003#
www.ti.com
33
Write Timing (using WR, WR-controlled)
Figure 39 shows the write-timing behavior when the WR(R/W) input is programmed as a write input WR only. The input
RD acts as the read input in this configuration. This timing is called WR-controlled because WR is the last external signal
of CS0, CS1, and WR, which becomes valid.
90%
10%
tsu
th
D(0–11)
DATA_AV
10%
tw(WR)
tsu(CS)
th(CS)
CS0
CS1
WR
RD
Figure 39. Write Timing Diagram Using WR (WR-controlled)
Write Timing Parameter Using WR (WR-controlled)
PARAMETER
MIN
TYP
MAX
UNIT
tsu(CS)
Setup time, CS stable to last WR valid
0
ns
tsu
Setup time, data valid to first WR invalid
5
ns
th
Hold time, WR invalid to data invalid
2
ns
th(CS)
Hold time, WR invalid to CS change
5
ns
tw(WR)
Pulse duration, WR active
10
ns
相关PDF资料 |
PDF描述 |
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