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参数资料
| 型号： | TMR320R2812PGFA |
| 厂商： | Texas Instruments, Inc. |
| 元件分类： | 数字信号处理 |
| 英文描述： | TMS320R2811, TMS320R2812 Digital Signal Processors |
| 中文描述： | TMS320R2811，TMS320R2812数字信号处理器 |
| 文件页数： | 90/147页 |
| 文件大小： | 2021K |
| 代理商： | TMR320R2812PGFA |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页当前第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页
Electrical Specifications
90
June 2004
SPRS257
6.12
Device Clock Table
This section provides the timing requirements and switching characteristics for the various clock options
available on R281x DSPs. Table 6
2 lists the cycle times of various clocks.
Table 6
2. TMS320R281x Clock Table and Nomenclature
MIN
28.6
NOM
MAX
UNIT
ns
On chip oscillator clock
On-chip oscillator clock
t
c(OSC)
, Cycle time
Frequency
50
20
35
MHz
XCLKIN
t
c(CI)
, Cycle time
Frequency
6.67
250
ns
4
150
MHz
SYSCLKOUT
t
c(SCO)
, Cycle time
Frequency
6.67
500
ns
2
150
MHz
XCLKOUT
t
c(XCO)
, Cycle time
Frequency
6.67
2000
ns
0.5
150
MHz
HSPCLK
t
c(HCO)
, Cycle time
Frequency
6.67
13.3
75
26.6
37.5
ns
150
MHz
LSPCLK
t
c(LCO)
, Cycle time
Frequency
t
c(ADCCLK)
, Cycle time
Frequency
13.3
ns
75
MHz
ADC clock
40
ns
25
MHz
SPI clock
t
c(SPC)
, Cycle time
Frequency
50
ns
20
MHz
McBSP
t
c(CKG)
, Cycle time
Frequency
50
ns
20
MHz
XTIMCLK
t
c(XTIM)
, Cycle time
Frequency
6.67
ns
150
MHz
The maximum value for ADCCLK frequency is 25 MHz. For SYSCLKOUT values of 25 MHz or lower, ADCCLK has to be SYSCLKOUT/2 or lower.
ADCCLK = SYSCLKOUT is not a valid mode for any value of SYSCLKOUT.
This is the default reset value if SYSCLKOUT = 150 MHz.
6.13
Clock Requirements and Characteristics
6.13.1
Input Clock Requirements
The clock provided at the XCLKIN pin generates the internal CPU clock cycle.
Table 6
3. Input Clock Frequency
PARAMETER
MIN
20
20
TYP
MAX
UNIT
Resonator
Crystal
XCLKIN
35
35
150
f
x
Input clock frequency
MHz
4
f
l
Limp mode clock frequency
2
MHz
A
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