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参数资料
型号： TMX320F28069PFPA
厂商： Texas Instruments
文件页数： 3/174页
文件大小： 0K
描述： IC MCU 32BIT 128KB FLASH 80LQFP
产品培训模块： ControlSUITE
Piccolo F2806x
Motor Signal Chain Overview
TPS75005 Single IC Power for C2000 MCU
标准包装： 1
系列： TMS320F2806x, Piccolo™, C2000™
核心处理器： C28x
芯体尺寸： 32-位
速度： 80MHz
连通性： CAN，I²C，McBSP，SCI，SPI，UART/USART
外围设备： 欠压检测/复位，DMA，POR，PWM，WDT
输入/输出数： 40
程序存储器容量： 256KB（128K x 16）
程序存储器类型： 闪存
RAM 容量： 50K x 16
电压 - 电源 (Vcc/Vdd)： 1.71 V ~ 1.995 V
数据转换器： A/D 12x12b
振荡器型： 内部
工作温度： -40°C ~ 85°C
封装/外壳： 80-TQFP 裸露焊盘
包装： 托盘
其它名称： 296-32777
TMX320F28069PFPA-ND
TMS320F28069, TMS320F28068, TMS320F28067, TMS320F28066
TMS320F28065, TMS320F28064, TMS320F28063, TMS320F28062
SPRS698D – NOVEMBER 2010 – REVISED DECEMBER 2012
www.ti.com
Table 5-29. SPI Master Mode External Timing (Clock Phase = 0)(1)(2)(3)(4)(5)
SPI WHEN (SPIBRR + 1) IS EVEN OR
SPI WHEN (SPIBRR + 1) IS ODD
SPIBRR = 0 OR 2
AND SPIBRR > 3
NO.
UNIT
MIN
MAX
MIN
MAX
1
tc(SPC)M
Cycle time, SPICLK
4tc(LCO)
128tc(LCO)
5tc(LCO)
127tc(LCO)
ns
2
tw(SPCH)M
Pulse duration, SPICLK high
0.5tc(SPC)M – 10
0.5tc(SPC)M
0.5tc(SPC)M – 0.5tc(LCO) – 10
0.5tc(SPC)M – 0.5tc(LCO)
ns
(clock polarity = 0)
tw(SPCL)M
Pulse duration, SPICLK low
0.5tc(SPC)M – 10
0.5tc(SPC)M
0.5tc(SPC)M – 0.5tc(LCO) – 10
0.5tc(SPC)M – 0.5tc(LCO)
(clock polarity = 1)
3
tw(SPCL)M
Pulse duration, SPICLK low
0.5tc(SPC)M – 10
0.5tc(SPC)M
0.5tc(SPC)M + 0.5tc(LCO) – 10
0.5tc(SPC)M + 0.5tc(LCO)
ns
(clock polarity = 0)
tw(SPCH)M
Pulse duration, SPICLK high
0.5tc(SPC)M – 10
0.5tc(SPC)M
0.5tc(SPC)M + 0.5tc(LCO) – 10
0.5tc(SPC)M + 0.5tc(LCO)
(clock polarity = 1)
4
td(SPCH-SIMO)M
Delay time, SPICLK high to SPISIMO
10
ns
valid (clock polarity = 0)
td(SPCL-SIMO)M
Delay time, SPICLK low to SPISIMO
10
valid (clock polarity = 1)
5
tv(SPCL-SIMO)M
Valid time, SPISIMO data valid after
0.5tc(SPC)M – 10
0.5tc(SPC)M + 0.5tc(LCO) – 10
ns
SPICLK low (clock polarity = 0)
tv(SPCH-SIMO)M
Valid time, SPISIMO data valid after
0.5tc(SPC)M – 10
0.5tc(SPC)M + 0.5tc(LCO) – 10
SPICLK high (clock polarity = 1)
8
tsu(SOMI-SPCL)M
Setup time, SPISOMI before SPICLK
26
ns
low (clock polarity = 0)
tsu(SOMI-SPCH)M
Setup time, SPISOMI before SPICLK
26
high (clock polarity = 1)
9
tv(SPCL-SOMI)M
Valid time, SPISOMI data valid after
0.25tc(SPC)M – 10
0.5tc(SPC)M – 0.5tc(LCO) – 10
ns
SPICLK low (clock polarity = 0)
tv(SPCH-SOMI)M
Valid time, SPISOMI data valid after
0.25tc(SPC)M – 10
0.5tc(SPC)M – 0.5tc(LCO) – 10
SPICLK high (clock polarity = 1)
(1)
The MASTER/SLAVE bit (SPICTL.2) is set and the CLOCK PHASE bit (SPICTL.3) is cleared.
(2)
tc(SPC) = SPI clock cycle time = LSPCLK/4 or LSPCLK/(SPIBRR +1)
(3)
tc(LCO) = LSPCLK cycle time
(4)
Internal clock prescalers must be adjusted such that the SPI clock speed is limited to the following SPI clock rate:
Master mode transmit 20-MHz MAX, master mode receive 10-MHz MAX
Slave mode transmit 10-MHz MAX, slave mode receive 10-MHz MAX.
(5)
The active edge of the SPICLK signal referenced is controlled by the clock polarity bit (SPICCR.6).
100
Peripheral and Electrical Specifications
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参数描述
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