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参数资料
| 型号： | TOOLSTICK360PP |
| 厂商： | Silicon Laboratories Inc |
| 文件页数： | 53/288页 |
| 文件大小： | 0K |
| 描述： | ADAPTER PROGRAM TOOLSTICK F360 |
| 标准包装： | 1 |
| 系列： | ToolStick |
| 类型： | 微控制器编程器 |
| 适用于相关产品： | C8051F360 |
| 所含物品： | 2 个板和 USB 连接线缆 |
| 相关产品： | 336-1407-ND - IC 8051 MCU 32K FLASH 48TQFP |
| 其它名称： | 336-1483 |
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C8051F360/1/2/3/4/5/6/7/8/9
146
Rev. 1.0
The replacement algorithm is selected with the Cache Algorithm bit, CHALGM (CCH0TN.3). When
CHALGM is cleared to ‘0’, the cache will use the rebound algorithm to replace cache locations. The
rebound algorithm replaces locations in order from the beginning of cache memory to the end, and then
from the end of cache memory to the beginning. When CHALGM is set to ‘1’, the cache will use the
pseudo-random algorithm to replace cache locations. The pseudo-random algorithm uses a pseudo-ran-
dom number to determine which cache location to replace. The cache can be manually emptied by writing
a ‘1’ to the CHFLUSH bit (CCH0CN.4).
SLOT = 4 Instruction
Data Bytes
0
TAG 27
SLOT 27
V27
TAG 31
SLOT 31
V31
TAG 30
SLOT 30
V30
TAG 2
SLOT 2
V2
TAG 1
SLOT 1
V1
TAG 0
SLOT 0
V0
TAG 29
SLOT 29
V29
TAG 28
SLOT 28
V28
LINEAR TAG
LINEAR SLOT
VL
Prefetch Data
Valid
Bit
Address
Data
Cache Data
TAG = 13 MSBs of Absolute FLASH Address
A14
A2
A1 A0
1
0
1
Byte 0
Byte 1
Byte 2
Byte 3
Figure 14.2. Branch Target Cache Organization
14.2. Cache and Prefetch Optimization
By default, the branch target cache is configured to provide code speed improvements for a broad range of
circumstances. In most applications, the cache control registers should be left in their reset states.
Sometimes it is desirable to optimize the execution time of a specific routine or critical timing loop. The
branch target cache includes options to exclude caching of certain types of data, as well as the ability to
pre-load and lock time-critical branch locations to optimize execution speed.
The most basic level of cache control is implemented with the Cache Miss Penalty Threshold bits, CHM-
STH (CCH0TN.1–0). If the processor is stalled during a prefetch operation for more clock cycles than the
number stored in CHMSTH, the requested data will be cached when it becomes available. The CHMSTH
bits are set to zero by default, meaning that any time the processor is stalled, the new data will be cached.
If, for example, CHMSTH is equal to 2, any cache miss causing a delay of 3 or 4 clock cycles will be
cached, while a cache miss causing a delay of 1–2 clock cycles will not be cached.
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PDF描述 |
|---|---|
| RBM10DSEH | CONN EDGECARD 20POS .156 EYELET |
| RBM08DRXI | CONN EDGECARD 16POS DIP .156 SLD |
| RW2-4812D/SMD | CONV DC/DC 2W 36-72VIN +/-12VOUT |
| S471K29X7RP63K5R | CAP CER 470PF 2KV 10% RADIAL |
| RBM08DRUI | CONN EDGECARD 16POS DIP .156 SLD |
相关代理商/技术参数 |
参数描述 |
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| TOOLSTICK370-A-DC | 功能描述:子卡和OEM板 ToolStk C8051F37x/9x Daugter Card RoHS:否 制造商:BeagleBoard by CircuitCo 产品:BeagleBone LCD4 Boards 用于:BeagleBone - BB-Bone - Open Source Development Kit |
| TOOLSTICK381DC | 功能描述:子卡和OEM板 Low-Cost Eval board RoHS:否 制造商:BeagleBoard by CircuitCo 产品:BeagleBone LCD4 Boards 用于:BeagleBone - BB-Bone - Open Source Development Kit |
| TOOLSTICK410PP | 功能描述:插座和适配器 Dev Tool C8051F410/2 MCUs RoHS:否 制造商:Silicon Labs 产品:Adapter 用于:EM35x |
| TOOLSTICK411DC | 功能描述:子卡和OEM板 ToolStick C8051F411 Daughter Card RoHS:否 制造商:BeagleBoard by CircuitCo 产品:BeagleBone LCD4 Boards 用于:BeagleBone - BB-Bone - Open Source Development Kit |
| TOOLSTICK411PP | 功能描述:插座和适配器 Dev Tool for C8051F411/3 MCUs RoHS:否 制造商:Silicon Labs 产品:Adapter 用于:EM35x |
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