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参数资料
| 型号： | TPS62410DRCRG4 |
| 厂商： | Texas Instruments |
| 文件页数： | 26/33页 |
| 文件大小： | 0K |
| 描述： | IC REG BUCK SYNC ADJ 0.8A 10SON |
| 标准包装： | 3,000 |
| 类型： | 降压（降压） |
| 输出类型： | 可调式 |
| 输出数： | 2 |
| 输出电压： | 0.6 V ~ 6 V |
| 输入电压： | 2.5 V ~ 6 V |
| PWM 型： | 电压模式 |
| 频率 - 开关： | 2.25MHz |
| 电流 - 输出： | 800mA |
| 同步整流器： | 是 |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 10-VFDFN 裸露焊盘 |
| 包装： | 带卷 (TR) |
| 供应商设备封装： | 10-SON 裸露焊盘（3x3） |
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www.ti.com
SLVS737 – FEBRUARY 2007
Connect the GND Pin of the device to the PowerPAD of the PCB and use this Pad as a star point. For each
converter use a common Power GND node and a different node for the Signal GND to minimize the effects of
ground noise. Connect these ground nodes together to the PowerPAD (star point) underneath the IC. Keep the
common path to the GND PIN, which returns the small signal components and the high current of the output
capacitors as short as possible to avoid ground noise. The output voltage sense lines (FB 1, ADJ2, DEF_1)
should be connected right to the output capacitor and routed away from noisy components and traces (e.g., SW
line). If the EasyScale interface is operated with high transmission rates, the MODE/DATA trace must be routed
away from the ADJ2 line to avoid capacitive coupling into the ADJ2 pin. A GND guard ring between the
MODE/DATA pin and ADJ2 pin avoids potential noise coupling.
TPS62410
VIN 2.5 V – 6 V
VIN
C IN
10 m F
EN_1
EN_2
MODE/
DATA
L2
FB 1
L1
C ff2
3.3 m H
SW2
SW1
3.3 m H
C OUT2
33 pF
R21
ADJ2
DEF_1
R11
C OUT2
R22
PowerPAD
GND
R12
Figure 35. Layout Diagram
26
相关PDF资料 |
PDF描述 |
|---|---|
| MAX6314US34D1+T | IC RESET CIRCUIT 3.40V SOT143-4 |
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相关代理商/技术参数 |
参数描述 |
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