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参数资料
| 型号： | TPS659102A1RSLR |
| 厂商： | TEXAS INSTRUMENTS INC |
| 元件分类： | 电源管理 |
| 英文描述： | 1-CHANNEL POWER SUPPLY SUPPORT CKT, PQCC48 |
| 封装： | 6 X 6 MM, 1 MM HEIGHT, 0.40 MM PITCH, GREEN, PLASTIC, VQFN-48 |
| 文件页数： | 30/93页 |
| 文件大小： | 1014K |
| 代理商： | TPS659102A1RSLR |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页当前第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页
1.2 V
SCLSR_EN2
PFM (pulse
skipping) mode
SW1
VDD1/VFB1
0.8 V
PFM (pulse
skipping) mode
PFM (pulse skipping) mode
PWM mode
t
dDVSEN
t
dDVSENL
t
dDVSEN
TSTEP[2:0]=001
TSTEP[2:0]=011
t
dDVSENL
SWCS046-021
SWCS046-025
SW3
SW2
SWIO
SW1
t
dswio2sw1
t
dswio2sw2
t
dswio2sw3
t
dviosync
SWCS046I
– MARCH 2010 – REVISED JULY 2011
VDD1 and VDD2 Voltage Control Through SCLSR_EN1 and SDASR_EN2 Signals
Figure 10 shows the VDD1 and VDD2 voltage control through the SCLSR_EN1 and SDASR_EN2 signals timing
characteristics.
NOTE: Register setting: VDD1_EN1 = 1, SEL[6:0] = hex13 in VDD1_SR_REG
Figure 10. VDD1 Supply Voltage Control Though SCLSR_EN1
Table 9. VDD1 Supply Voltage Control Through SCLSR_EN1 Timing Characteristics
PARAMETER
TEST CONDITIONS
MIN
TYP
MAX
UNIT
tdDVSEN: SCLSR_EN1 or SCLSR_EN2 edge to
2
× tCK32k = 62
s
VDD1 or VDD2 voltage change delay
tdDVSENL: VDD1 or VDD2 voltage settling delay
TSTEP[2:0] = 001
32
s
TSTEP[2:0] = 011 (default)
0.4/7.5 = 53
TSTEP[2:0] = 111
160
SMPS Switching Synchronization
Figure 11 shows the SMPS switching synchronization timing characteristics.
NOTE: VDD1 or VDD2 switching synchronization is available in PWM mode (VDD1_PSKIP = 0 or VDD2_PSKIP = 0). SMPS
external clock (GPIO_CKSYNC) synchronization is available when VIO PWM mode is set (VIO_PSKIP = 0).
Figure 11. SMPS Switching Synchronization
Table 10. SMPS Switching Synchronization Timing Characteristics
PARAMETER
TEST CONDITIONS
MIN
TYP
MAX
UNIT
VDD1_PSKIP = 0,
tdSWIO2SW1: delay from SWIO rising edge to SW1
DCDCCKSYNC[1:0] = 11
160
ns
rising edge
DCDCCKSYNC[1:0] = 01
220
VDD2_PSKIP = 0,
tdSWIO2SW2: delay from SWIO rising edge to SW1
DCDCCKSYNC[1:0] = 11
160
ns
rising edge
DCDCCKSYNC[1:0] = 01
290
tdSWIO2SW3: delay from SWIO rising edge to SW3
206
ns
rising edge
36
Copyright
2010–2011, Texas Instruments Incorporated
相关PDF资料 |
PDF描述 |
|---|---|
| TPS65070TRSLRQ1 | POWER SUPPLY SUPPORT CKT, PQCC48 |
| TS3810CXDRF | 1-CHANNEL POWER SUPPLY SUPPORT CKT, PDSO3 |
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| TC151A1813EOA713 | 0.25 A SWITCHING REGULATOR, 50 kHz SWITCHING FREQ-MAX, PDSO8 |
| TC151A2914EOA713 | 0.25 A SWITCHING REGULATOR, 50 kHz SWITCHING FREQ-MAX, PDSO8 |
相关代理商/技术参数 |
参数描述 |
|---|---|
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