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参数资料
| 型号： | TSC21020F-20MA |
| 英文描述： | IC CYCLONE III FPGA 16K 256FBGA |
| 中文描述： | 32位数字信号处理器 |
| 文件页数： | 32/51页 |
| 文件大小： | 763K |
| 代理商： | TSC21020F-20MA |
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32
TSC21020F
4153F
–
AERO
–
06/03
Figure 4.
Reset
Interrupts
Figure 5.
Interrupts
Timer
Figure 6.
TIMEXP
Parameter
20 MHz
Frequency
Dependency
(1)
Unit
Min
t
SIR
IRQ3-0 Setup before CLKIN High
38
38 + 3DT/4
ns
t
HIR
IRQ3-0 Hold after CLKIN High
0
ns
t
IPW
IRQ3-0 Pulse Width
55
t
CK
+ 5
ns
Note:
1. DT = t
CK
- 50 ns
Meeting setup and hold guarantees interrupts will be latched in that cycle. Meeting
the pulse width is not necessary if the setup and hold is met. Likewise, meeting the
setup and hold is not necessary if the pulse width is met. See the Hardware Config-
uration chapter of the
ADSP-21020 User’s Manual
from Analog Devices for interrupt
servicing information.
Parameter
20 MHz
Frequency
Dependency
(1)
Unit
Max
Min
Max
t
DTEX
CLKIN High to TIMEXP
24
ns
Note:
1. DT = t
CK
- 50 ns
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