参数资料
| 型号： | TZA1038HW,118 |
| 厂商： | NXP Semiconductors |
| 文件页数： | 13/45页 |
| 文件大小： | 0K |
| 描述： | IC DVD SIGNAL PROC 48-HTQFP |
| 标准包装： | 2,500 |
| 系列： | * |
| 类型： | * |
| 应用： | * |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 48-TQFP 裸露焊盘 |
| 供应商设备封装： | 48-HTQFP |
| 包装： | 带卷 (TR) |
| 其它名称： | 935273843118 TZA1038HW-T TZA1038HW-T-ND |
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2003 Sep 03
20
Philips Semiconductors
Product specication
High speed advanced analog DVD signal
processor and laser supply
TZA1038HW
7.3.5
REGISTER 4: RF LEFT AND RIGHT, OR SUM OFFSET COMPENSATION
Table 10 Register address 4H
Table 11 Description of register bits (address 4H)
7.3.6
REGISTER 5: RF SUM OFFSET COMPENSATION
Table 12 Register address 5H
Table 13 Description of register bits (address 5H)
BIT
15
14
13
12
11
10
9
8
SYMBOL
AD3
AD2
AD1
AD0
RFOFFSL5RFOFFSL4RFOFFSL3RFOFFSL2
BIT
7
6
543210
SYMBOL
RFOFFSL1RFOFFSL0RFOFFSR5/
RFOFFSS5
RFOFFSR4/
RFOFFSS4
RFOFFSR3/
RFOFFSS3
RFOFFSR2/
RFOFFSS2
RFOFFSR1/
RFOFFSS1
RFOFFSR0/
RFOFFSS0
BIT
SYMBOL
FUNCTION
15 to 12
AD[3:0]
0100 = address 4H
11 to 6
RFOFFSL[5:0]
Left channel RF offset compensation denition.
bit RFSUM = 0: left RF channel offset compensation value
bit RFSUM = 1: not used
5to0
RFOFFSR[5:0]
Right channel RF offset compensation denition.
bit RFSUM = 0: right RF channel offset compensation value (symbol is RFOFFSR)
bit RFSUM = 1 and bit DPD_DCC = 1: not used
bit RFSUM = 1 and bit DPD_DCC = 0: the decoder controls DPD and RFSUM
channels automatically, in parallel and with same values (symbol is RFOFFSS).
BIT
15
14
13
12
11
10
9
8
SYMBOL
AD3
AD2
AD1
AD0
BIT
7
6
543210
SYMBOL
RFOFFSS5RFOFFSS4RFOFFSS3RFOFFSS2RFOFFSS1RFOFFSS0
BIT
SYMBOL
FUNCTION
15 to 12
AD[3:0]
0101 = address 5H
11 to 6
not used
5to0
RFOFFSS[5:0]
RF offset compensation denition.
bit RFSUM = 0: not used
bit RFSUM = 1 and bit DPD_DCC = 0: not used
bit RFSUM = 1 and bit DPD_DCC = 1: the decoder controls RFSUM channels;
the DPD channels can be set independently from the microprocessor.
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PDF描述 |
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