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参数资料
| 型号： | UPD70F3714GC-8BS-A |
| 厂商： | Renesas Electronics America |
| 文件页数： | 106/320页 |
| 文件大小： | 0K |
| 描述： | MCU 32BIT V850ES/LX2 64-LQFP |
| 标准包装： | 300 |
| 系列： | V850ES/Ix2 |
| 核心处理器： | V850ES |
| 芯体尺寸： | 32-位 |
| 速度： | 20MHz |
| 连通性： | CSI，UART/USART |
| 外围设备： | LVD，PWM，WDT |
| 输入/输出数： | 39 |
| 程序存储器容量： | 128KB（128K x 8） |
| 程序存储器类型： | 闪存 |
| RAM 容量： | 6K x 8 |
| 电压 - 电源 (Vcc/Vdd)： | 3.5 V ~ 5.5 V |
| 数据转换器： | A/D 8x10b |
| 振荡器型： | 外部 |
| 工作温度： | -40°C ~ 85°C |
| 封装/外壳： | 64-LQFP |
| 包装： | 托盘 |
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PIC32MX1XX/2XX
DS61168D-page 194
Preliminary
2011-2012 Microchip Technology Inc.
REGISTER 20-1:
RTCCON: RTC CONTROL REGISTER(1)
Bit
Range
Bit
31/23/15/7
Bit
30/22/14/6
Bit
29/21/13/5
Bit
28/20/12/4
Bit
27/19/11/3
Bit
26/18/10/2
Bit
25/17/9/1
Bit
24/16/8/0
31:24
U-0
R/W-0
—
—CAL<9:8>
23:16
R/W-0
CAL<7:0>
15:8
R/W-0
U-0
R/W-0
U-0
ON(2,3)
—SIDL
—
7:0
R/W-0
R-0
U-0
R/W-0
R-0
R/W-0
RTSECSEL(4) RTCCLKON
—
—RTCWREN(5) RTCSYNC HALFSEC(6)
RTCOE
Legend:
R = Readable bit
W = Writable bit
U = Unimplemented bit, read as ‘0’
-n = Value at POR
‘1’ = Bit is set
‘0’ = Bit is cleared
x = Bit is unknown
bit 31-26 Unimplemented: Read as ‘0’
bit 25-16 CAL<9:0>: RTC Drift Calibration bits, which contain a signed 10-bit integer value
0111111111 = Maximum positive adjustment, adds 511 RTC clock pulses every one minute
0000000001 = Minimum positive adjustment, adds 1 RTC clock pulse every one minute
0000000000 = No adjustment
1111111111 = Minimum negative adjustment, subtracts 1 RTC clock pulse every one minute
1000000000 = Minimum negative adjustment, subtracts 512 clock pulses every one minute
bit 15
ON: RTCC On bit(2,3)
1 = RTCC module is enabled
0 = RTCC module is disabled
bit 14
Unimplemented: Read as ‘0’
bit 13
SIDL: Stop in Idle Mode bit
1 = Disables the PBCLK to the RTCC when CPU enters in Idle mode
0 = Continue normal operation in Idle mode
bit 12-8
Unimplemented: Read as ‘0’
bit 7
RTSECSEL: RTCC Seconds Clock Output Select bit(4)
1 = RTCC Seconds Clock is selected for the RTCC pin
0 = RTCC Alarm Pulse is selected for the RTCC pin
bit 6
RTCCLKON: RTCC Clock Enable Status bit
1 = RTCC Clock is actively running
0 = RTCC Clock is not running
bit 5-4
Unimplemented: Read as ‘0’
Note 1: This register is reset only on a Power-on Reset (POR).
2: The ON bit is only writable when RTCWREN = 1.
3: When using the 1:1 PBCLK divisor, the user’s software should not read/write the peripheral’s SFRs in the
SYSCLK cycle immediately following the instruction that clears the module’s ON bit.
4: Requires RTCOE = 1 (RTCCON<0>) for the output to be active.
5: The RTCWREN bit can be set only when the write sequence is enabled.
6: This bit is read-only. It is cleared to ‘0’ on a write to the seconds bit fields (RTCTIME<14:8>).
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参数描述 |
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