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参数资料
| 型号： | UPD720113GK-9EU-A |
| 厂商： | Renesas Electronics America |
| 文件页数： | 4/34页 |
| 文件大小： | 0K |
| 描述： | IC HUB CTLR USB2.0 7-PORTS QFP |
| 标准包装： | 50 |
| 控制器类型： | USB 2.0 集线器控制器 |
| 接口： | USB 2.0 |
| 电源电压： | 2.5 V，3.3 V |
| 工作温度： | 0°C ~ 70°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 80-TQFP |
| 供应商设备封装： | 80-TQFP |
| 包装： | 托盘 |
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Data Sheet S16618EJ3V0DS
10
PD720113
Recommended Operating Ranges
Parameter
Symbol
Condition
MIN.
TYP.
MAX.
Unit
Operating voltage
VDD33
3.3 V for VDD33 pins
3.14
3.30
3.46
V
VDD25
2.5 V for VDD25 pins
2.3
2.5
2.7
V
AVDD
2.5 V for AVDD pins
2.3
2.5
2.7
V
High-level input voltage
VIH
2.5 V High-level input voltage
1.7
VDD25
V
3.3 V High-level input voltage
2.0
VDD33
V
5.0 V High-level input voltage
2.0
5.5
V
Low-level input voltage
VIL
2.5 V Low-level input voltage
0
0.7
V
3.3 V Low-level input voltage
0
0.8
V
5.0 V Low-level input voltage
0
0.8
V
Hysteresis voltage
VH
5 V Hysteresis voltage
0.3
1.5
V
3.3 V Hysteresis voltage
0.2
1.0
V
Input rise time for SYSRSTB
trst
10
ms
Input rise time
tri
Normal buffer
0
200
ns
Schmitt buffer
0
10
ms
Input fall time
tfi
Normal buffer
0
200
ns
Schmitt buffer
0
10
ms
Two power supply rails limitation.
The
PD720113 has two power supply rails (2.5 V, 3.3 V). The system will require the time when power supply
rail is stable at VDD level. And, there will be difference between the time of VDD25 and VDD33. The
PD720113
requires that VDD25 should be stable before VDD33 becomes stable. At any case, the system must ensure that the
absolute maximum ratings for VI /VO are not exceeded. System reset signaling should be asserted more than
specified time after both VDD25 and VDD33 are stable.
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PDF描述 |
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参数描述 |
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