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参数资料
| 型号： | V827332N04SXT-B0 |
| 厂商： | MOSEL-VITELIC |
| 元件分类： | DRAM |
| 英文描述： | 32M X 72 DDR DRAM MODULE, 0.75 ns, DMA184 |
| 封装： | DIMM-184 |
| 文件页数： | 14/15页 |
| 文件大小： | 450K |
| 代理商： | V827332N04SXT-B0 |
8
MOSEL VITELIC
V827332N04S
V827332N04S Rev. 1.1 May 2002
AC Operating Test Conditions (TA = 0 to 70°C, Voltage referenced to VSS = 0V)
Input/Output Capacitance
(VDD = 2.5V, VDDQ = 2.5V, TA = 25°C, f = 1MHz)
Parameter
Value
Unit
Reference Voltage
VDDQ x 0.5
V
Termination Voltage
VDDQ x 0.5
V
AC Input High Level Voltage (VIH, min)
VREF + 0.31
V
AC Input Low Level Voltage (VIL, max)
VREF - 0.31
V
Input Timing Measurement Reference Level Voltage
VREF
V
Output Timing Measurement Reference Level Voltage
VTT
V
Input Signal maximum peak swing
1.5
V
Input minimum Signal Slew Rate
1
V/ns
Termination Resistor (RT)
50
Ohm
Series Resistor (RS)
25
Ohm
Output Load Capacitance for Access Time Measurement (CL)
30
pF
Parameter
Symbol
Min
Max
Unit
Input capacitance (A0 ~ A11, BA0 ~ BA1, RAS, CAS, WE)
CIN1
60
75
pF
Input capacitance (CKE0)
CIN2
40
48
pF
Input capacitance (CS0)
CIN3
40
48
pF
Input capacitance (CLK1, CLK2)
CIN4
30
32
pF
Data & DQS input/output capacitance (DQ0~DQ63)
COUT
10
12
pF
Input capacitance (DM0~DM8)
CIN5
10
12
pF
Output Load Circuit (SSTL_2)
Output
Z0=50
CLOAD=30pF
VREF
=0.5*VDDQ
RT=50
Vtt=0.5*VDDQ
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