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参数资料
| 型号： | W3EG72256MS100AJD3MF |
| 英文描述： | 2GB-256Mx72 DDR SDRAM REGISTERED ECC w/PLL |
| 中文描述： | 2GB的- 256Mx72 ECC的DDR SDRAM的注册瓦特/锁相环 |
| 文件页数： | 3/14页 |
| 文件大小： | 320K |
| 代理商： | W3EG72256MS100AJD3MF |
White Electronic Designs
W3EG72256S-JD3
-AJD3
PRELIMINARY
3
White Electronic Designs Corporation (602) 437-1520 www.wedc.com
December 2004
Rev. 2
FUNCTIONAL BLOCK DIAGRAM
WE#
CKE1
CAS#
BA0-A13
CS0#
CKO
SDRAM
V
SS
RCS0#
DQS0
DQS1
DQS2
DQS3
DQS4
DQS5
DQS6
DQS7
DQS8
R
E
G
I
S
T
E
R
DQ0
DQ1
DQ2
DQ3
DQ8
DQ9
DQ10
DQ11
DQ16
DQ17
DQ18
DQ19
DQ24
DQ25
DQ26
DQ27
DQ32
DQ33
DQ34
DQ35
DQ40
DQ41
DQ42
DQ43
DQ48
DQ49
DQ50
DQ51
DQ56
DQ57
DQ58
DQ59
CB0
CB1
CB2
CB3
RESET#
PCK#
PCK
RCS0#
RBA0 - RBA1
RA0 - RA13
RRAS#
RCAS#
RCKE0
RCKE1
RWE#
I/O 3
I/O 2
I/O 1
I/O 0
DQS
CS#
DM
I/O 3
I/O 2
I/O 1
I/O 0
DQS
CS#
DM
I/O 3
I/O 2
I/O 1
I/O 0
DQS
CS#
DM
I/O 3
I/O 2
I/O 1
I/O 0
DQS
CS#
DM
I/O 3
I/O 2
I/O 1
I/O 0
DQS
CS#
DM
I/O 3
I/O 2
I/O 1
I/O 0
DQS
CS#
DM
I/O 3
I/O 2
I/O 1
I/O 0
DQS
CS#
DM
I/O 3
I/O 2
I/O 1
I/O 0
DQS
CS#
DM
I/O 3
I/O 2
I/O 1
I/O 0
DQS
CS#
DM
DQS10
DQS11
DQS12
DQS13
DQS14
DQS15
DQS16
DQS17
DQ4
DQ5
DQ6
DQ7
DQ12
DQ13
DQ14
DQ20
DQ21
DQ22
DQ28
DQ29
DQ30
DQ31
DQ36
DQ37
DQ38
DQ44
DQ45
DQ46
DQ52
DQ53
DQ54
DQ60
DQ61
DQ62
DQ63
CB4
CB5
CB6
CB7
I/O 3
I/O 2
I/O 1
I/O 0
DQS
CS#
DM
I/O 3
I/O 2
I/O 1
I/O 0
DQS
CS#
DM
I/O 3
I/O 2
I/O 1
I/O 0
DQS
CS#
DM
I/O 3
I/O 2
I/O 1
I/O 0
DQS
CS#
DM
I/O 3
I/O 2
I/O 1
I/O 0
DQS
CS#
DM
I/O 3
I/O 2
I/O 1
I/O 0
DQS
CS#
DM
I/O 3
I/O 2
I/O 1
I/O 0
DQS
CS#
DM
I/O 3
I/O 2
I/O 1
I/O 0
DQS
CS#
DM
I/O 3
I/O 2
I/O 1
I/O 0
DQS
CS#
DM
DQS9
V
CCSPD
V
CC
/V
CCQ
V
REF
V
SS
SPD
DDR SDRAMs
DDR SDRAMs
DDR SDRAMs
DDR SDRAMs
DDR SDRAMs
DDR SDRAMs
DDR SDRAMs
DDR SDRAMs
DDR SDRAMs
DDR SDRAMs
Serial PD
A0
SA0 SA1
SA2
A1
A2
SDA
WP
CKO#
REGISTER
PLL
SCL
Notes:
1.
DQ-to-I/O wiring is shown as
recommended but may be changed.
DQ/DQS/DM/CKE/S relationships
must be maintained as shown.
2.
NOTE: All resistor values are 22 ohms unless otherwise specified
相关PDF资料 |
PDF描述 |
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参数描述 |
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