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参数资料
| 型号： | W681511SG |
| 厂商： | Nuvoton Technology Corporation of America |
| 文件页数： | 8/32页 |
| 文件大小： | 0K |
| 描述： | IC VOICEBAND CODEC 5V 1CH 20SOP |
| 其它有关文件： | CODEC Block Diagram |
| 标准包装： | 38 |
| 类型： | PCM |
| 数据接口： | PCM 音频接口 |
| 分辨率（位）： | 8 b |
| ADC / DAC 数量： | 1 / 1 |
| 三角积分调变： | 无 |
| 电压 - 电源，模拟： | 4.5 V ~ 5.5 V |
| 电压 - 电源，数字： | 4.5 V ~ 5.5 V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 20-SOIC（0.295"，7.50mm 宽） |
| 供应商设备封装： | 20-SOP |
| 包装： | 管件 |
| 配用： | W681513DK-ND - KIT DEVELOPMENT FOR W681513 W681512DK-ND - KIT DEVELOPMENT FOR W681512 W681511DK-ND - KIT DEVELOPMENT FOR W681511 W681512ES-ND - EVALUATION SYSTEM FOR W681512 |
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W681511
Publication Release Date: January 2009
- 16 -
Revision A11
Figure 8.3 IDL PCM Timing
SYMBOL
DESCRIPTION
MIN
TYP
MAX
UNIT
1/TFS
FST Frequency
---
8
---
kHz
1/TBCK
BCLKT Frequency
256
---
4096
kHz
TBCKH
BCLKT High Pulse Width
50
---
ns
TBCKL
BCLKT Low Pulse Width
50
---
ns
TFSRH
BCLKT –1 Falling Edge to FST Rising Edge
Hold Time
20
---
ns
TFSRS
FST Rising Edge to BCLKT 0 Falling edge
Setup Time
60
---
ns
TFSFH
BCLKT 0 Falling Edge to FST Falling Edge
Hold Time
20
---
ns
TBDTD
BCLKT Rising Edge to Valid PCMT Delay
Time
10
---
60
ns
THID
Delay Time from the BCLKT 8 Falling Edge
(B1 channel) or BCLKT 18 Falling Edge (B2
Channel) to PCMT Output High Impedance
10
---
50
ns
TDRS
Valid PCMR to BCLKT Falling Edge Setup
Time
20
---
ns
TDRH
PCMR Hold Time from BCLKT Falling Edge
75
---
ns
Table 8.3 IDL PCM Timing Parameters
FST
BCL K T
PCM T
PCM R
D7 D6 D5 D 4 D3 D 2 D 1 D0
D7 D6 D5 D4 D3 D2
D1 D 0
D7 D6 D5 D 4 D3 D 2 D 1 D0
D7 D6 D5 D4 D3 D2
D1 D0
0
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
T
FS
T
FSRH
T
FSFH
T
FSRS
T
BD TD
T
BDTD
T
BDTD
T
BDT D
T
HI D
T
HI D
T
DRS
T
DRS
T
DRH
T
DRH
BCH = 0
B 1 Channel
BCH = 1
B 2 Channel
MSB
LSB
T
BCK
T
BCK H
T
BCK L
-1
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PDF描述 |
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参数描述 |
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