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参数资料
| 型号： | W78E858A40PL |
| 厂商： | Nuvoton Technology Corporation of America |
| 文件页数： | 11/35页 |
| 文件大小： | 0K |
| 描述： | IC MCU 8-BIT 32K FLASH 44-PLCC |
| 标准包装： | 30 |
| 系列： | W78 |
| 核心处理器： | 8052 |
| 芯体尺寸： | 8-位 |
| 速度： | 40MHz |
| 连通性： | EBI/EMI，串行端口 |
| 外围设备： | POR，PWM，WDT |
| 输入/输出数： | 36 |
| 程序存储器容量： | 32KB（32K x 8） |
| 程序存储器类型： | 闪存 |
| RAM 容量： | 768 x 8 |
| 电压 - 电源 (Vcc/Vdd)： | 4.5 V ~ 5.5 V |
| 振荡器型： | 内部 |
| 工作温度： | 0°C ~ 70°C |
| 封装/外壳： | 44-PLCC |
| 包装： | 管件 |
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W78E858
Publication Release Date: April 22, 2008
- 19 -
Revision A8
5.16 External Interrupts INT2 to INT9
Port1 lines serve an alternative purpose at eight additional interrupts INT2 to INT9. When enabled,
each of these lines may "wake-up" the device from power-down mode. Using the IX1 register, the
each pin may be initialized to either active HIGH or LOW. IRQ1 is the interrupt request flag register.
Each flag, if the interrupt is enabled will be set on an interrupt request but must be cleared by
software, i.e. via the interrupt software or when the interrupt is disable.
The Port1 interrupts are level sensitive. A Port1 interrupt will be recognized when a level (HIGH or
LOW depending on Interrupt Polarity Register IX1) on P1.x is held active for at least one machine
cycle. The interrupt request is not served until the next machine cycle.
5.16.1 IE_1 (E8H)
BIT
NAME
FUNCTION
7
EX9
Enable external interrupt 9
6
EX8
Enable external interrupt 8
5
EX7
Enable external interrupt 7
4
EX6
Enable external interrupt 6
3
EX5
Enable external interrupt 5
2
EX4
Enable external interrupt 4
1
EX3
Enable external interrupt 3
0
EX2
Enable external interrupt 2
5.16.2 IP1 (F8H)
BIT
NAME
FUNCTION
7
PX9
External interrupt 9 priority level
6
PX8
External interrupt 8 priority level
5
PX7
External interrupt 7 priority level
4
PX6
External interrupt 6 priority level
3
PX5
External interrupt 5 priority level
2
PX4
External interrupt 4 priority level
1
PX3
External interrupt 3 priority level
0
PX2
External interrupt 2 priority level
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PDF描述 |
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