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参数资料
| 型号： | X80201V20I |
| 厂商： | Intersil |
| 文件页数： | 6/16页 |
| 文件大小： | 0K |
| 描述： | IC PWR SUPPLY SEQUENCER 20TSSOP |
| 标准包装： | 75 |
| 应用： | 电源序列发生器 |
| 电源电压： | 0.95 V ~ 5.5 V |
| 电流 - 电源： | 2.5mA |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 20-TSSOP（0.173"，4.40mm 宽） |
| 供应商设备封装： | 20-TSSOP |
| 包装： | 管件 |
X80200, X80201, X80202, X80203, X80204
Bus Interface AC Timing
TEST
SMBUS
2-WIRE BUS
SYMBOL
f SCL
Clock Frequency
PARAMETER
CONDITION
MIN
10
MAX
100
MIN
MAX
400
UNITS
kHz
t CYC
Clock Cycle Time
10
2.5
μs
t HIGH
t LOW
t SU:STA
t HD:STA
t SU:STO
t SU:DAT
t HD:DAT
t R
t F
Clock High Time
Clock Low Time
Start Set-up Time
Start Hold Time
Stop Set-up Time
SDA Data Input Set-up Time
SDA Data Hold Time
SCL and SDA Rise Time: TR = (V ILMAX - 0.15) to
(V IHMIN +0.15)
SCL and SDA Fall Time: TF = (V IHMIN - 0.15) to
(V ILMAX - 0.15)
(Note 1)
(Note 1)
4.0
4.7
4.7
4.0
4.0
250
300
50
1000
300
0.6
1.3
0.6
0.6
0.6
100
0
300
300
μs
μs
μs
μs
μs
ns
ns
ns
ns
t AA
t DH
T I
t BUF
SCL Low to SDA Data Output Valid Time
SDA Data Output Hold Time
Noise Suppression Time Constant at SCL and SDA inputs
Bus Free Time (Prior to Any Transmission)
(Note 1)
(Note 1)
(Note 1)
(Note 1)
550
300
50
4.7
1100
250
0
50
1.3
1100
ns
ns
ns
μs
t SU:A
t HD:A
A0, A1, A2 Set-up Time
A0, A1, A2 Hold Time
0
0
0
0
ns
ns
Timing Diagrams
t BUF
t F
t HIGH
t LOW
t R
t BUF
SCL
SDA IN
t SU:STA
t HD:STA
t SU:DAT
t HD:DAT
t SU:STO
t HD:STO
SDA OUT
START
FIGURE 1. BUS TIMING
t AA
t DH
t HD:DAT
SCL
CLK 1
CLK 9
SLAVE ADDRESS BYTE
SDA IN
A2, A1, A0
6
t SU:A
FIGURE 2. ADDRESS PIN TIMING
t HD:A
FN8154.0
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