参数资料
| 型号： | XC3S1600E-4FGG400I |
| 厂商： | Xilinx Inc |
| 文件页数： | 70/227页 |
| 文件大小： | 0K |
| 描述： | IC FPGA SPARTAN-3E 1600K 400FBGA |
| 标准包装： | 60 |
| 系列： | Spartan®-3E |
| LAB/CLB数： | 3688 |
| 逻辑元件/单元数： | 33192 |
| RAM 位总计： | 663552 |
| 输入/输出数： | 304 |
| 门数： | 1600000 |
| 电源电压： | 1.14 V ~ 1.26 V |
| 安装类型： | 表面贴装 |
| 工作温度： | -40°C ~ 100°C |
| 封装/外壳： | 400-BGA |
| 供应商设备封装： | 400-FBGA（21x21） |
| 配用： | HW-XA3S1600E-UNI-G-ND - KIT DEVELOPMENT AUTOMOTIVE ECU |
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Spartan-3E FPGA Family: Pinout Descriptions
DS312 (v4.1) July 19, 2013
Product Specification
161
Electronic versions of the package pinout tables and foot-
prints are available for download from the Xilinx website.
Download the files from the following location:
Using a spreadsheet program, the data can be sorted and
reformatted according to any specific needs. Similarly, the
ASCII-text file is easily parsed by most scripting programs.
Table 129: Maximum User I/O by Package
Device
Package
Maximum
User I/Os
and
Input-Only
Maximum
Input-
Only
Maximum
Differential
Pairs
All Possible I/Os by Type
I/O
INPUT
DUAL
N.C.
XC3S100E
VQ100
66
7
30
16
1
21
4
24
0
XC3S250E
66
7
30
16
1
21
4
24
0
XC3S500E
66
7
30
16
1
21
4
24
0
XC3S100E
CP132
83
11
35
16
2
42
7
16
9
XC3S250E
92
7
41
22
0
46
8
16
0
XC3S500E
92
7
41
22
0
46
8
16
0
XC3S100E
TQ144
108
28
40
22
19
42
9
16
0
XC3S250E
108
28
40
20
21
42
9
16
0
XC3S250E
PQ208
158
32
65
58
25
46
13
16
0
XC3S500E
158
32
65
58
25
46
13
16
0
XC3S250E
FT256
172
40
68
62
33
46
15
16
18
XC3S500E
190
41
77
76
33
46
19
16
0
XC3S1200E
190
40
77
78
31
46
19
16
0
XC3S500E
FG320
232
56
92
102
48
46
20
16
18
XC3S1200E
250
56
99
120
47
46
21
16
0
XC3S1600E
250
56
99
120
47
46
21
16
0
XC3S1200E
FG400
304
72
124
156
62
46
24
16
0
XC3S1600E
304
72
124
156
62
46
24
16
0
XC3S1600E
FG484
376
82
156
214
72
46
28
16
0
Notes:
1.
Some VREF pins are on INPUT pins. See pinout tables for details.
2.
All devices have 24 possible global clock and right- and left-half side clock inputs. The right-half and bottom-edge clock pins have shared
functionality in some FPGA configuration modes. Consequently, some clock pins are counted in the DUAL column. 4 GCLK pins, including
2 DUAL pins, are on INPUT pins.
相关PDF资料 |
PDF描述 |
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相关代理商/技术参数 |
参数描述 |
|---|---|
| XC3S1600E-4FGG484C | 制造商:Xilinx 功能描述:FPGA SPARTAN-3E 1.6M GATES 33192 CELLS 572MHZ 90NM 1.2V 484F - Trays 制造商:Xilinx 功能描述:FPGA SPARTAN-3E 1600K GATES 484FBGA |
| XC3S1600E-4FGG484I | 功能描述:IC FPGA SPARTAN-3E 1600K 484FBGA RoHS:是 类别:集成电路 (IC) >> 嵌入式 - FPGA（现场可编程门阵列） 系列:Spartan®-3E 产品变化通告:Step Intro and Pkg Change 11/March/2008 标准包装:1 系列:Virtex®-5 SXT LAB/CLB数:4080 逻辑元件/单元数:52224 RAM 位总计:4866048 输入/输出数:480 门数:- 电源电压:0.95 V ~ 1.05 V 安装类型:表面贴装 工作温度:-40°C ~ 100°C 封装/外壳:1136-BBGA，FCBGA 供应商设备封装:1136-FCBGA 配用:568-5088-ND - BOARD DEMO DAC1408D750122-1796-ND - EVALUATION PLATFORM VIRTEX-5 |
| XC3S1600E-4FT256C | 制造商:XILINX 制造商全称:XILINX 功能描述:Spartan-3E FPGA Family |
| XC3S1600E-4FT256I | 制造商:XILINX 制造商全称:XILINX 功能描述:Spartan-3E FPGA Family |
| XC3S1600E-4FTG256C | 制造商:XILINX 制造商全称:XILINX 功能描述:Spartan-3E FPGA Family |
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