参数资料
| 型号： | XC3S400-4PQ208C |
| 厂商： | Xilinx Inc |
| 文件页数： | 6/272页 |
| 文件大小： | 0K |
| 描述： | IC SPARTAN-3 FPGA 400K 208PQFP |
| 标准包装： | 24 |
| 系列： | Spartan®-3 |
| LAB/CLB数： | 896 |
| 逻辑元件/单元数： | 8064 |
| RAM 位总计： | 294912 |
| 输入/输出数： | 141 |
| 门数： | 400000 |
| 电源电压： | 1.14 V ~ 1.26 V |
| 安装类型： | 表面贴装 |
| 工作温度： | 0°C ~ 85°C |
| 封装/外壳： | 208-BFQFP |
| 供应商设备封装： | 208-PQFP（28x28） |
| 其它名称： | Q2844431 XC3S4004PQ208C XC3S4004PQ208C-ND |
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Spartan-3 FPGA Family: DC and Switching Characteristics
DS099 (v3.1) June 27, 2013
Product Specification
103
X-Ref Target - Figure 39
Figure 39: JTAG Waveforms
Table 68: Timing for the JTAG Test Access Port
Symbol
Description
All Speed Grades
Units
Min
Max
Clock-to-Output Times
TTCKTDO
The time from the falling transition on the TCK pin to data appearing at
the TDO pin
1.0
11.0
ns
Setup Times
TTDITCK
The time from the setup of data at the TDI pin to the rising transition at
the TCK pin
7.0
–ns
TTMSTCK
The time from the setup of a logic level at the TMS pin to the rising
transition at the TCK pin
7.0
–ns
Hold Times
TTCKTDI
The time from the rising transition at the TCK pin to the point when data
is last held at the TDI pin
0
–ns
TTCKTMS
The time from the rising transition at the TCK pin to the point when a logic
level is last held at the TMS pin
0
–ns
Clock Timing
TTCKH
TCK pin High pulse width
5
∞
ns
TTCKL
TCK pin Low pulse width
5
∞
ns
FTCK
Frequency of the TCK signal
JTAG Configuration
0
33
MHz
Boundary-Scan
0
25
MHz
Notes:
1.
The numbers in this table are based on the operating conditions set forth in Table 32.
TCK
TTMSTCK
TMS
TDI
TDO
(Input)
(Output)
TTCKTMS
TTCKTDI
TTCKTDO
TTDITCK
TCCH
TCCL
1/FTCK
DS099_06_102909
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