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参数资料
| 型号： | XC5204-6PG191C |
| 厂商： | Xilinx, Inc. |
| 英文描述： | Field Programmable Gate Arrays |
| 中文描述： | 现场可编程门阵列 |
| 文件页数： | 49/73页 |
| 文件大小： | 598K |
| 代理商： | XC5204-6PG191C |
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R
November 5, 1998 (Version 5.2)
7-135
XC5200 Series Field Programmable Gate Arrays
7
* VQ64 package supports Master Serial, Slave Serial, and Express configuration modes only.
Additional No Connect (N.C.) Connections on TQ144 Package
Notes: Boundary Scan Bit 0 = TDO.T
Boundary Scan Bit 1 = TDO.O
Boundary Scan Bit 1056 = BSCAN.UPD
Pin Locations for XC5204 Devices
The following table may contain pinout information for unsupported device/package combinations. Please see the
availability charts elsewhere in the XC5200 Series data sheet for availability information.
CCLK
48
73
77
74
107
R2
-
VCC
-
74
78
75
108
P3
-
74.
I/O (TDO)
49
75
79
76
109
T1
0
GND
-
76
80
77
110
N3
-
75.
I/O (A0, WS)50
77
81
78
111
R1
9
76.
GCK4 (A1, I/O)
51
78
82
79
112
P2
15
77.
I/O (A2, CS1)
52
79
83
80
115
P1
18
78.
I/O (A3)
-
80
84
81
116
N1
21
GND
-
118
L3
-
79.
I/O (A4)
-
81
85
82
121
K3
27
80.
I/O (A5)
53
82
86
83
122
K2
30
81.
I/O
-
87
84
123
K1
33
82.
I/O
-
88
85
124
J1
39
83.
I/O (A6)
54
83
89
86
125
J2
42
84.
I/O (A7)
55
84
90
87
126
J3
45
GND
56
1
91
88
127
H2
-
TQ144
135
9
41
67
98
117
136
10
42
68
99
119
140
25
46
77
103
120
141
26
47
78
104
4
30
62
82
113
5
31
63
83
114
Pin
Description
PC84
PQ100
VQ100
TQ144
PG156
PQ160
Boundary Scan Order
VCC
2
92
89
128
H3
142
-
1.
I/O (A8)
3
93
90
129
H1
143
78
2.
I/O (A9)
4
94
91
130
G1
144
81
3.
I/O
-
95
92
131
G2
145
87
4.
I/O
-
96
93
132
G3
146
90
5.
I/O (A10)
5
97
94
133
F1
147
93
6.
I/O (A11)
6
98
95
134
F2
148
99
7.
I/O
-
135
E1
149
102
8.
I/O
-
136
E2
150
105
GND
-
137
F3
151
-
9.
I/O
-
D1
152
111
10.
I/O
-
D2
153
114
11.
I/O (A12)
7
99
96
138
E3
154
117
12.
I/O (A13)
8
100
97
139
C1
155
123
13.
I/O
-
140
C2
156
126
Pin
Description
VQ64*
PC84
PQ100
VQ100
TQ144
PG156
Boundary Scan Order
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PDF描述 |
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