参数资料
| 型号： | XC6SLX75T-3FG484I |
| 厂商： | Xilinx Inc |
| 文件页数： | 71/89页 |
| 文件大小： | 0K |
| 描述： | IC FPGA SPARTAN 6 484FGGBGA |
| 标准包装： | 60 |
| 系列： | Spartan® 6 LXT |
| LAB/CLB数： | 5831 |
| 逻辑元件/单元数： | 74637 |
| RAM 位总计： | 3170304 |
| 输入/输出数： | 268 |
| 电源电压： | 1.14 V ~ 1.26 V |
| 安装类型： | 表面贴装 |
| 工作温度： | -40°C ~ 100°C |
| 封装/外壳： | 484-BBGA |
| 供应商设备封装： | 484-FBGA |
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Spartan-6 FPGA Data Sheet: DC and Switching Characteristics
DS162 (v3.0) October 17, 2011
Product Specification
73
Table 71: Global Clock Setup and Hold Without DCM or PLL (Default Delay)
Symbol
Description
Device
Speed Grade
Units
-3
-3N
-2
-1L
Input Setup and Hold Time Relative to Global Clock Input Signal for LVCMOS25 Standard.(1)
TPSFD/ TPHFD
Default Delay(2) Global Clock and
IFF(3) without DCM or PLL
XC6SLX4
0.66/1.17
N/A
1.05/0.79
2.09/1.05
ns
XC6SLX9
0.66/1.17
0.75/1.17
1.05/1.17
2.09/1.05
ns
XC6SLX16
0.87/1.16
0.93/1.16
0.96/1.16
1.86/1.06
ns
XC6SLX25
0.68/0.77
0.81/0.81
0.87/0.82
2.21/1.33
ns
XC6SLX25T
0.68/0.77
0.81/0.81
0.87/0.82
N/A
ns
XC6SLX45
0.40/1.05
0.42/1.17
0.64/1.20
1.61/1.67
ns
XC6SLX45T
0.40/1.05
0.42/1.17
0.64/1.20
N/A
ns
XC6SLX75
0.41/1.11
0.41/1.13
0.80/1.14
1.23/1.82
ns
XC6SLX75T
0.41/1.11
0.41/1.13
0.80/1.14
N/A
ns
XC6SLX100
0.39/1.12
0.39/1.23
0.39/1.28
1.13/1.94
ns
XC6SLX100T
0.39/1.12
0.39/1.23
0.39/1.28
N/A
ns
XC6SLX150
0.23/1.54
0.23/1.62
1.14/2.05
ns
XC6SLX150T
0.23/1.54
0.23/1.62
N/A
ns
XA6SLX4
0.73/1.18
N/A
1.05/0.80
N/A
ns
XA6SLX9
0.73/1.18
N/A
1.05/0.80
N/A
ns
XA6SLX16
0.90/1.20
N/A
0.96/0.75
N/A
ns
XA6SLX25
0.70/0.81
N/A
0.87/0.91
N/A
ns
XA6SLX25T
0.76/0.81
N/A
1.03/0.91
N/A
ns
XA6SLX45
0.40/1.06
N/A
0.64/1.20
N/A
ns
XA6SLX45T
0.40/1.06
N/A
0.64/1.20
N/A
ns
XA6SLX75
0.41/1.24
N/A
0.80/1.18
N/A
ns
XA6SLX75T
0.41/1.24
N/A
0.80/1.18
N/A
ns
XA6SLX100
N/A
0.86/1.55
N/A
ns
XQ6SLX75
N/A
0.80/1.18
1.23/1.82
ns
XQ6SLX75T
0.41/1.24
N/A
0.80/1.18
N/A
ns
XQ6SLX150
N/A
0.28/1.57
1.14/2.05
ns
XQ6SLX150T
0.28/1.78
N/A
0.28/1.57
N/A
ns
Notes:
1.
Setup and Hold times are measured over worst case conditions (process, voltage, temperature). Setup time is measured relative to the
Global Clock input signal using the slowest process, highest temperature, and lowest voltage. Hold time is measured relative to the Global
Clock input signal using the fastest process, lowest temperature, and highest voltage.
2.
Default delay uses IODELAY2 tap 0.
3.
IFF = Input Flip-Flop or Latch.
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