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参数资料
| 型号： | XC6VCX240T-2FFG1156C |
| 厂商： | Xilinx Inc |
| 文件页数： | 17/52页 |
| 文件大小： | 0K |
| 描述： | IC FPGA VIRTEX 6 241K 1156FFGBGA |
| 产品培训模块： | Virtex-6 FPGA Overview |
| 产品变化通告： | Virtex-6 FIFO Input Logic Reset 18/Apr/2011 |
| 标准包装： | 1 |
| 系列： | Virtex® 6 CXT |
| LAB/CLB数： | 18840 |
| 逻辑元件/单元数： | 241152 |
| RAM 位总计： | 15335424 |
| 输入/输出数： | 600 |
| 电源电压： | 0.95 V ~ 1.05 V |
| 安装类型： | 表面贴装 |
| 工作温度： | 0°C ~ 85°C |
| 封装/外壳： | 1156-BBGA，FCBGA |
| 供应商设备封装： | 1156-FCBGA（35x35） |
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Virtex-6 CXT Family Data Sheet
DS153 (v1.6) February 11, 2011
Product Specification
24
Performance Characteristics
This section provides the performance characteristics of some common functions and designs implemented in Virtex-6 CXT
devices. The numbers reported here are worst-case values; they have all been fully characterized. These values are subject
to the same guidelines as the Switching Characteristics, page 25.
Table 35: Interface Performances
Description
Speed Grade
-2
-1
Networking Applications
SDR LVDS transmitter (using OSERDES; DATA_WIDTH = 4 to 8)
650 Mb/s
625 Mb/s
DDR LVDS transmitter (using OSERDES; DATA_WIDTH = 4 to 10)
1.25 Gb/s
1.0 Gb/s
SDR LVDS receiver (SFI-4.1)(1)
650 Mb/s
625 Mb/s
DDR LVDS receiver (SFI-4.2)(1)
1.0 Gb/s
0.9 Gb/s
Maximum Physical Interface (PHY) Rate for Memory Interfaces(2)(3)
DDR2
666 Mb/s
DDR3
800 Mb/s
666 Mb/s
QDR II + SRAM
250 MHz
Notes:
1.
LVDS receivers are typically bounded with certain applications where specific DPA algorithms dominate deterministic performance.
2.
Based on Xilinx memory characterization platforms designed according to the guidelines in the Virtex-6 FPGA Memory Interface Solutions
User Guide.
3.
Consult the Virtex-6 FPGA Memory Interface Solutions Data Sheet for performance and feature information on memory interface cores
(controller plus PHY).
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