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参数资料
| 型号： | XE8000EV108 |
| 厂商： | Semtech |
| 文件页数： | 62/143页 |
| 文件大小： | 0K |
| 描述： | EVAL BOARD FOR XE8806/XE8807 |
| 标准包装： | 1 |
| 类型： | MCU |
| 适用于相关产品： | XE88LC06AMI026 |
| 所含物品： | 完全组装的评估板 |
| 产品目录页面： | 585 (CN2011-ZH PDF) |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页当前第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页
Semtech 2006
www.semtech.com
4-3
XE8806A/XE8807A
code
access mode
r
bit can be read
w
bit can be written
r0
bit always reads 0
r1
bit always reads 1
c
bit is cleared by writing any value
c1
bit is cleared by writing a 1
ca
bit is cleared after reading
s
special function, verify the detailed description in the respective peripherals
Table 4-1. Access mode codes used in the register definitions
code
reset source
glob
nresetglobal
cold
nresetcold
pconf
nresetpconf
sleep
nresetsleep
Table 4-2. Reset source coding used in the register definitions
4.2.1
Low power data registers (h0000-h0007)
Name
Address
7
6
5
4
3
2
1
0
Reg00
h0000
Reg00[7:0]
rw,00000000,glob
Reg01
h0001
Reg01[7:0]
rw,00000000,glob
Reg02
h0002
Reg02[7:0]
rw,00000000,glob
Reg03
h0003
Reg03[7:0]
rw,00000000,glob
Reg04
h0004
Reg04[7:0]
rw,00000000,glob
Reg05
h0005
Reg05[7:0]
rw,00000000,glob
Reg06
h0006
Reg06[7:0]
rw,00000000,glob
Reg07
h0007
Reg07[7:0]
rw,0000000,glob
Table 4-3. Low power data registers
4.2.2
System, clock configuration and reset configuration (h0010-h001F)
Name
Address
7
6
5
4
3
2
1
0
RegSysCtrl
h0010
SleepEn
rw,0,cold
EnResetPConf
rw,0,cold
EnBusError
rw,0,cold
EnResetWD
rw,0,cold
r0
RegSysReset
h0011
Sleep
rw,0,glob
SleepFlag
rc,0,cold
ResetBusError
rc, 0, cold
ResetWD
rc, 0, cold
ResetfromportA
rc, 0, cold
r0
RegSysClock
h0012
CpuSel
rw,0,sleep
r0
EnExtClock
rw,0,cold
BiasRC
rw,1,cold
ColdXtal
r,1,sleep
r0
EnableXtal
rw,0,sleep
EnableRC
rw,1,sleep
RegSysMisc
h0013
r0
Output16k
rw,0,sleep
OutputCpuCk
rw,0,sleep
RegSysWd
h0014
r0
WatchDog[3:0]
s,0000,glob
RegSysPre0
h0015
r0
ClearLowPresca
l
c1r0,0,-
RegSysRcTrim1
h001B
r0
RcFreqRange
rw,0,cold
RcFreqCoarse[3:0]
rw,0001,cold
RegSysRcTrim2
h001C
r0
RcFreqFine[5:0]
rw,00000,cold
Table 4-4. Reset block and clock block registers
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PDF描述 |
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