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参数资料
| 型号： | XIO2200AEVM |
| 厂商： | Texas Instruments |
| 文件页数： | 12/202页 |
| 文件大小： | 0K |
| 描述： | XIO2200AEVM |
| 标准包装： | 1 |
| 主要目的： | 接口，PCI 至 PCI 桥 |
| 已用 IC / 零件： | XIO2200A |
| 次要属性： | LED 状态指示器 |
| 已供物品： | 模块 |
| 相关产品： | 296-21636-ND - IC PCI-EXPRESS/BUS BRIDGE 175BGA 296-19617-ND - IC PCI-EXPRESS/BUS BRIDGE 176BGA 296-19567-ND - IC PCI-EXPRESS/BUS BRIDGE 176BGA 296-19486-ND - IC PCI-EXPRESS/BUS BRIDGE 176BGA 296-19485-ND - IC PCI-EXPRESS/BUS BRIDGE 176BGA |
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PCI Express Extended Configuration Space
96
March 5 2007 June 2011
SCPS154C
5.22 VC Resource Control Register (VC0)
The VC resource control register for VC0 allows software to control VC0 and the associated port and
arbitration schemes supported by the bridge. See Table 518 for a complete description of the register
contents.
PCI Express extended register offset:
164h
Register type:
Read-only, Read/Write
Default value:
8000 00FFh
BIT NUMBER
31
30
29
28
27
26
25
24
23
22
21
20
19
18
17
16
RESET STATE
1
0
BIT NUMBER
15
14
13
12
11
10
9
8
7
6
5
4
3
2
1
0
RESET STATE
0
1
Table 518. VC Resource Control Register (VC0) Description
BIT
FIELD NAME
ACCESS
DESCRIPTION
31
VC_EN
R
VC enable. This field is internally hardwired to 1b to indicate that this VC resource is always
enabled.
30:27
RSVD
R
Reserved. Returns 0h when read.
26:24
VC_ID
R
Virtual channel ID. This field is internally hardwired to 000b to indicate that this VC resource
is always used for VC0.
23:20
RSVD
R
Reserved. Returns 0h when read.
19:17
PORT_ARB_SELECT
R
Port arbitration select. This read-only field returns 000b when read, because only
hardware-fixed, round-robin arbitration is supported for this VC.
16
LOAD_PORT_TABLE
R
Load port arbitration table. This read-only bit returns 0b when read, because no port
arbitration table is supported for this VC.
15:8
RSVD
R
Reserved. Returns 00h when read.
7:0
TC_VC_MAP
RW
TC/VC map. This field indicates all of the traffic classes that are mapped to this VC. A 1b in
any bit position indicates that the corresponding traffic class is enabled for this VC. A 0b
indicates that the corresponding traffic class is mapped to a different VC. The following table
is used:
Bit 0 = Traffic class 0 (This bit is read-only and returns a value of 1b)
Bit 1 = Traffic class 1
Bit 2 = Traffic class 2
Bit 3 = Traffic class 3
Bit 4 = Traffic class 4
Bit 5 = Traffic class 5
Bit 6 = Traffic class 6
Bit 7 = Traffic class 7
The default value of FFh indicates that all eight traffic classes are initially mapped to VC0.
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| XIO2200AZGW | 功能描述:外围驱动器与原件 - PCI PCI Exp-PCI Bus Trans Bridge RoHS:否 制造商:PLX Technology 工作电源电压: 最大工作温度: 安装风格:SMD/SMT 封装 / 箱体:FCBGA-1156 封装:Tray |
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