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参数资料
| 型号： | XR18W750IL48-F |
| 厂商： | Exar Corporation |
| 文件页数： | 19/44页 |
| 文件大小： | 0K |
| 描述： | IC WIRELESS UART CTRLR 48QFN |
| 标准包装： | 260 |
| 功能： | 控制器 |
| RF 型： | 通用 |
| 次要属性： | I²C 接口 |
| 封装/外壳： | 48-VFQFN 裸露焊盘 |
| 包装： | 托盘 |
| 其它名称： | 1016-1473 XR18W750IL48-F-ND |
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XR18W750
REV. 1.0.0
WIRELESS UART CONTROLLER
.
T ABLE 8: INTERNAL REGISTERS DESCRIPTION. S HADED BITS ARE ENABLED WHEN EFR B IT -4=1
A DDRESS
A2 A1 A0
R EG
N AME
R EAD /
W RITE
B IT -7
B IT -6
B IT -5
B IT -4
B IT -3
B IT -2
B IT -1
B IT -0
C OMMENT
16C550 Compatible Registers
0 0 0
0 0 0
RHR
THR
RD
WR
Bit-7
Bit-7
Bit-6
Bit-6
Bit-5
Bit-5
Bit-4
Bit-4
Bit-3
Bit-3
Bit-2
Bit-2
Bit-1
Bit-1
Bit-0
Bit-0
0 0 1
IER
RD/WR
0/ 0/
CTS Int. RTS Int.
Enable Enable
0/
0
Modem
Stat. Int.
Enable
RX Line TX RX
Stat. Empty Data
Int. Int Int.
Enable Enable Enable
LCR[7]=0
0 1 0
ISR
RD
FIFOs
FIFOs
0/
0/
INT
INT
INT
INT
Enabled Enabled
INT
Source
INT
Source
Source
Bit-3
Source Source Source
Bit-2 Bit-1 Bit-0
0 1 0
FCR
WR
RX FIFO RX FIFO
Bit-5
0/
Bit-4
0/
DMA
TX
RX
FIFOs
LCR ≠ 0xBF
Trigger
Trigger
TX FIFO TX FIFO
Trigger Trigger
Mode
Enable
FIFO
Reset
FIFO
Reset
Enable
0 1 1
LCR
RD/WR
Divisor
Set TX
Set Par-
Even
Parity
Stop
Word
Word
Enable
Break
ity
Parity
Enable
Bits
Length Length
Bit-1
Bit-0
1 0 0
MCR
RD/WR
0/
0/
0/
Internal OP2#/INT Rsrvd
RTS#
DTR#
Lopback
Enable
Output
Enable
(OP1#) Output Output
Control Control
1 0 1
LSR
RD
RX FIFO
Global
Error
THR &
TSR
Empty
THR
Empty
RX
Break
RX Fram-
ing Error
RX
Parity
Error
RX
Over-
run
RX
Data
Ready
LCR ≠ 0xBF
Error
1 1 0
MSR
RD
CD#
RI#
DSR#
CTS#
Delta
Delta
Delta
Delta
Input
Input
Input
Input
CD#
RI#
DSR#
CTS#
1 1 1
SPR
RD/WR
Bit-7
Bit-6
Bit-5
Bit-4
Bit-3
Bit-2
Bit-1
Bit-0
LCR ≠ 0xBF
FCTR[6]=0
1 1 1
EMSR
WR
Rsrvd
LSR
Auto
Auto
Rsrvd
Rsrvd
Rx/Tx
Rx/Tx
(1)
Error
Inter-
rupt.
Imd/Dly#
RTS
Hyst.
bit-3
RTS
Hyst.
bit-2
FIFO
Count
FIFO
Count
LCR ≠ 0xBF
FCTR[6]=1
1 1 1
FLVL
RD
Bit-7
Bit-6
Bit-5
Bit-4
Bit-3
Bit-2
Bit-1
Bit-0
19
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PDF描述 |
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参数描述 |
|---|---|
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