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参数资料
| 型号： | XRT86VL38IB-F |
| 厂商： | Exar Corporation |
| 文件页数： | 105/160页 |
| 文件大小： | 0K |
| 描述： | IC LIU/FRAMER T1/E1/J1 8CH 420BG |
| 标准包装： | 40 |
| 控制器类型： | T1/E1/J1 调帧器，LIU |
| 电源电压： | 3.3V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 420-BBGA |
| 供应商设备封装： | 420-PBGA |
| 包装： | 托盘 |
| 其它名称： | 1016-1487 XRT86VL38IB-F-ND |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页当前第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页第151页第152页第153页第154页第155页第156页第157页第158页第159页第160页
XRT86VL38
44
REV. V1.2.0
OCTAL T1/E1/J1 FRAMER/LIU COMBO - T1 REGISTER DESCRIPTION
TABLE 29: GAPPED CLOCK CONTROL REGISTER (GCCR)
HEX ADDRESS: 0Xn11E
BIT
FUNCTION
TYPE
DEFAULT
DESCRIPTION-OPERATION
7
FrOutclk
R/W
0
Framer Output Clock Reference
This bit is used to enable or disable high-speed T1 rate on the
T1OSCCLK and the E1OSCCLK output pins.
By default, the output clock reference on T1OSCCLK and
E1OSCCLK output pins are set to 1.544MHz/2.048MHz respectively.
By setting this bit to a “1”, the output clock reference on the
T1OSCLK and the E1OSCCLK are changed to 49.408MHz/
65.536MHz respectively.
0 = Disables high-speed rate to be output on the T1OSCCLK and
E1OSCCLK output pins.
1 = Enables high-speed rate to be output on the T1OSCCLK and
E1OSCCLK output pins.
[6:2] Reserved
-
Reserved
1
TxGCCR
R/W
0
Transmit Gapped Clock Interface
This bit is used to enable or disable the transmit gapped clock inter-
face operating at 2.048Mbit/s in DS-1 mode. In this application, 63
gaps (missing data) are inserted so that the overall bit rate is reduced
to 1.544Mbit/s.
If the transmit Gapped Clock Interface is enabled:
TxMSYNC is used as the 2.048MHz Gapped Clock Input.
TxSER is used as the 2.048MHz Gapped Data Input.
TxSERCLK must be a 1.544MHz clock input.
0 = Disables the transmit gapped clock interface.
1 = Enables the transmit gapped clock interface.
0
RxGCCR
R/W
0
Receive Gapped Clock Interface
This bit is used to enable or disable the receive gapped clock inter-
face operating at 2.048Mbit/s in DS-1 mode. In this application, 63
gaps (missing data) are extracted so that the overall bit rate is
reduced to 1.544Mbit/s.
If the Receive Gapped Clock Interface is enabled:
RxSERCLK should be configured as a Gapped clock input at
2.048MHz so that a 2.048MHz Gapped Clock can be applied to the
Framer block.
RxSER is used as the 2.048MHz Gapped Data Output. The position
of the gaps will be determined by the gaps placed on RxSERCLK by
the user.
0 = Disables the Receive Gapped Clock Interface
1 = Enables the Receive Gapped Clock Interface
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