参数资料
| 型号： | 20-101-0435 |
| 厂商： | Rabbit Semiconductor |
| 文件页数： | 70/100页 |
| 文件大小： | 0K |
| 描述： | MODULE RABBITCORE RCM2110 |
| 标准包装： | 1 |
| 系列： | RabbitCore® |
| 模块/板类型： | MPU 核心模块 |
| 适用于相关产品： | RCM2110 |
| 产品目录页面： | 620 (CN2011-ZH PDF) |
| 其它名称： | 316-1086 |
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User’s Manual
65
Figure A-4 shows a typical timing diagram for the Rabbit 2000 microprocessor external
I/O read and write cycles.
Figure A-4. External I/O Read and Write Cycles—No Extra Wait States
Tadr is the time required for the address output to reach 0.8 V. This time depends on the
bus loading. Tsetup is the data setup time relative to the clock. Tsetup is specified from
30%/70% of the VDD voltage level.
Tadr
External I/O Read (no extra wait states)
CLK
A[15:0]
External I/O Write (no extra wait states)
CLK
A[15:0]
/IORD
valid
T1
Tw
T1
Tw
T2
valid
T2
/BUFEN
/IOCSx
/IOWR
/BUFEN
D[7:0]
valid
Tsetup
Thold
/CSx
/IOCSx
TCSx
TIOCSx
TIORD
TBUFEN
TCSx
TIOCSx
TIORD
TBUFEN
valid
D[7:0]
/CSx
TCSx
TIOCSx
TIOWR
TCSx
TIOCSx
TIOWR
TBUFEN
TDHZV
TDVHZ
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PDF描述 |
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参数描述 |
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