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参数资料
| 型号： | 5962-9960702QXA |
| 元件分类： | SRAM |
| 英文描述： | 512K X 8 STANDARD SRAM, 25 ns, CDFP36 |
| 封装： | BOTTOM BRAZED, SHIELDED, DFP-36 |
| 文件页数： | 15/15页 |
| 文件大小： | 121K |
| 代理商： | 5962-9960702QXA |
9
Assumptions:
1. G < VIL (max). If G > VIH (min) then Q(8:0) will be
in three-state for the entire cycle.
2. G high for t AVAV cycle.
W
tAVWL
Figure 5a. SRAM Write Cycle 1: Write Enable - Controlled Access
A(18:0)
Q(7:0)
E
tAVAV2
D(7:0)
APPLIED DATA
t
DVWH
t
WHDX
tETWH
tWLWH
tWHAX
tWHQX
tWLQZ
tAVWH
t
WHWL
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