参数资料
| 型号： | AD421BRZRL |
| 厂商： | Analog Devices Inc |
| 文件页数： | 8/14页 |
| 文件大小： | 0K |
| 描述： | IC DAC 16BIT LOOP 4-20MA 16SOIC |
| 产品培训模块： | Data Converter Fundamentals DAC Architectures |
| 标准包装： | 1,000 |
| 设置时间： | 8ms |
| 位数： | 16 |
| 数据接口： | 串行 |
| 转换器数目： | 1 |
| 电压电源： | 单电源 |
| 功率耗散（最大）： | 450mW |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 16-SOIC（0.295"，7.50mm 宽） |
| 供应商设备封装： | 16-SOIC W |
| 包装： | 带卷 (TR) |
| 输出数目和类型： | 1 电流，单极 |
AD421
–3–
REV. C
TIMING CHARACTERISTICS1, 2, 3
Parameter
(B Versions)
Units
Conditions/Comments
tCK
100
ns min
Data Clock Period
tCL
50
ns min
Data Clock Low Time
tCH
50
ns min
Data Clock High Time
tDW
30
ns min
Data Stable Width
tDS
30
ns min
Data Setup Time
tDH
0
ns min
Data Hold Time
tLD
50
ns min
Latch Delay Time
tLL
50
ns min
Latch Low Time
tLH
50
ns min
Latch High Time
NOTES
1Guaranteed by characterization at initial product release, not production tested.
2See Figures 1 and 2.
3All input signals are specified with tr = tf = 5 ns (10% to 90% of V
CC ) and timed from a voltage level of (VIN + VIL )/2; tr and tf should not exceed 1
s on any digital
input.
Specifications subject to change without notice.
WORD "N"
WORD "N +1"
10
1
1 1
11
1
00
0
1
0
1
CLOCK
DATA
LATCH
B15
(MSB)
B14
B13
B12
B11
B10
B9
B8
B7
B6
B5
B4
B3
B2
B1
B0
B15
B14
B13
B12
(LSB)
Figure 1. Serial Interface Waveforms (Normal Data Load)
CLOCK
DATA
LATCH
t
CK
t
CL
t
CH
t
DS
t
DH
t
DW
t
LD
t
LL
t
LH
Figure 2. Serial Interface Timing Diagram
(VCC = +3 V to +5 V, TA = TMIN to TMAX unless otherwise noted)
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