参数资料
| 型号： | AD5172BRM2.5 |
| 厂商： | Analog Devices Inc |
| 文件页数： | 28/28页 |
| 文件大小： | 0K |
| 描述： | IC POT DUAL 2.5K 256POS 10-MSOP |
| 标准包装： | 50 |
| 接片： | 256 |
| 电阻（欧姆）： | 2.5k |
| 电路数： | 2 |
| 温度系数： | 标准值 35 ppm/°C |
| 存储器类型： | 非易失 |
| 接口： | I²C |
| 电源电压： | 2.7 V ~ 5.5 V |
| 工作温度： | -40°C ~ 125°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 10-TFSOP，10-MSOP（0.118"，3.00mm 宽） |
| 供应商设备封装： | 10-MSOP |
| 包装： | 管件 |
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Data Sheet
AD5172/AD5173
Rev. I | Page 9 of 28
PIN CONFIGURATIONS AND FUNCTION DESCRIPTIONS
B1
1
A1
2
W2
3
GND
4
VDD 5
W1
10
B2
9
A2
8
SDA
7
SCL
6
AD5172
TOP VIEW
(Not to Scale)
04103-
045
Figure 4. AD5172 Pin Configuration
Table 5. AD5172 Pin Function Descriptions
Pin
No.
Mnemonic
Description
1
B1
B1 Terminal. GND ≤ VB1 ≤ VDD.
2
A1
A1 Terminal. GND ≤ VA1 ≤ VDD.
3
W2
W2 Terminal. GND ≤ VW2 ≤ VDD.
4
GND
Digital Ground.
5
VDD
Positive Power Supply. Specified for
operation from 2.7 V to 5.5 V. For OTP
programming, VDD needs to be a minimum
of 5.6 V but no more than 5.8 V and to be
capable of driving 100 mA.
6
SCL
Serial Clock Input. Positive-edge triggered.
Requires a pull-up resistor. If this pin is driven
directly from a logic controller without a
pull-up resistor, ensure that the VIH minimum
is 0.7 V × VDD.
7
SDA
Serial Data Input/Output. Requires a pull-up
resistor. If this pin is driven directly from a
logic controller without a pull-up resistor,
ensure that the VIH minimum is 0.7 V × VDD.
8
A2
A2 Terminal. GND ≤ VA2 ≤ VDD.
9
B2
B2 Terminal. GND ≤ VB2 ≤ VDD.
10
W1
W1 Terminal. GND ≤ VW1 ≤ VDD.
B1
1
AD0
2
W2
3
GND
4
VDD 5
W1
10
B2
9
AD1
8
SDA
7
SCL
6
AD5173
TOP VIEW
(Not to Scale)
04103-
046
Figure 5. AD5173 Pin Configuration
Table 6. AD5173 Pin Function Descriptions
Pin
No.
Mnemonic
Description
1
B1
B1 Terminal. GND ≤ VB1 ≤ VDD.
2
AD0
Programmable Address Bit 0 for Multiple
Package Decoding.
3
W2
W2 Terminal. GND ≤ VW2 ≤ VDD.
4
GND
Digital Ground.
5
VDD
Positive Power Supply. Specified for
operation from 2.7 V to 5.5 V. For OTP
programming, VDD needs to be a minimum
of 5.6 V but no more than 5.8 V and to be
capable of driving 100 mA.
6
SCL
Serial Clock Input. Positive-edge triggered.
Requires a pull-up resistor. If this pin is driven
directly from a logic controller without a
pull-up resistor, ensure that the VIH minimum
is 0.7 V × VDD.
7
SDA
Serial Data Input/Output. Requires a pull-up
resistor. If this pin is driven directly from a
logic controller without a pull-up resistor,
ensure that the VIH minimum is 0.7 V × VDD.
8
AD1
Programmable Address Bit 1 for Multiple
Package Decoding.
9
B2
B2 Terminal. GND ≤ VB2 ≤ VDD.
10
W1
W1 Terminal. GND ≤ VW1 ≤ VDD.
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