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参数资料
| 型号： | AD5381BSTZ-5-REEL |
| 厂商： | Analog Devices Inc |
| 文件页数： | 39/40页 |
| 文件大小： | 0K |
| 描述： | IC DAC 12BIT 40CH 5V 100-LQFP |
| 产品培训模块： | Data Converter Fundamentals DAC Architectures |
| 产品变化通告： | AD5381,3 Redesign Change 24/Oct/2011 |
| 设计资源： | 40 Channels of Programmable Voltage with Excellent Temperature Drift Performance Using AD5381 (CN0010) AD5381 Channel Monitor Function (CN0013) |
| 标准包装： | 1 |
| 设置时间： | 6µs |
| 位数： | 12 |
| 数据接口： | 串行，并联 |
| 转换器数目： | 40 |
| 电压电源： | 单电源 |
| 功率耗散（最大）： | 80mW |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 100-LQFP |
| 供应商设备封装： | 100-LQFP（14x14） |
| 包装： | 标准包装 |
| 输出数目和类型： | 40 电压，单极 |
| 采样率（每秒）： | 167k |
| 其它名称： | AD5381BSTZ-5-REELDKR |
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AD5381
Data Sheet
Rev. D | Page 8 of 40
TIMING CHARACTERISTICS
SERIAL INTERFACE TIMING
DVDD = 2.7 V to 5.5 V; AVDD= 4.5 V to 5.5 V or 2.7 V to 3.6 V; AGND = DGND = 0 V;
all specifications T
MIN to TMAX, unless otherwise noted.
Table 5.
Parameter 1, 2, 3
Limit at T
MIN, TMAX
Unit
Description
t
1
33
ns min
SCLK cycle time
t
2
13
ns min
SCLK high time
t
3
13
ns min
SCLK low time
t
4
13
ns min
SYNC falling edge to SCLK falling edge setup time
t
13
ns min
24th SCLK falling edge to SYNC falling edge
t
33
ns min
Minimum SYNC low time
t
7
10
ns min
Minimum SYNC high time
t
7A
50
ns min
Minimum SYNC high time in Readback mode
t
8
5
ns min
Data setup time
t
9
4.5
ns min
Data hold time
t
30
ns max
24th SCLK falling edge to BUSY falling edge
t
11
670
ns max
BUSY pulse width low (single channel update)
t
20
ns min
24th SCLK falling edge to LDAC falling edge
t
13
20
ns min
LDAC pulse width low
t
14
2
s max
BUSY rising edge to DAC output response time
t
15
0
ns min
BUSY rising edge to LDAC falling edge
t
16
100
ns min
LDAC falling edge to DAC output response time
t
17
3
s typ
DAC output settling time
t
18
20
ns min
CLR pulse width low
t
19
40
s max
CLR pulse activation time
t
20
ns max
SCLK rising edge to SDO valid
t
5
ns min
SCLK falling edge to SYNC rising edge
t
8
ns min
SYNC rising edge to SCLK rising edge
t
23
20
ns min
SYNC rising edge to LDAC falling edge
1 Guaranteed by design and characterization, not production tested.
2 All input signals are specified with t
r = tf = 5 ns (10% to 90% of VCC) and are timed from a voltage level of 1.2 V.
4 Standalone mode only.
5 Daisy-chain mode only.
CL
50pF
TO OUTPUT PIN
VOH (MIN) OR
VOL (MAX)
200
A
200
A
IOL
IOH
03732-002
Figure 2. Load Circuit for Digital Output Timing
相关PDF资料 |
PDF描述 |
|---|---|
| DAC8412FPC | IC DAC 12BIT QUAD READBK 28-PLCC |
| VI-JWP-MZ-B1 | CONVERTER MOD DC/DC 13.8V 25W |
| VE-B1V-MU-S | CONVERTER MOD DC/DC 5.8V 200W |
| VI-JWM-MZ-B1 | CONVERTER MOD DC/DC 10V 25W |
| VE-B1N-MU-S | CONVERTER MOD DC/DC 18.5V 200W |
相关代理商/技术参数 |
参数描述 |
|---|---|
| AD5382BST-3 | 制造商:Analog Devices 功能描述:DAC 32-CH Resistor-String 14-bit 100-Pin LQFP 制造商:Rochester Electronics LLC 功能描述:32/40-CHANNEL 3V/5V SINGLE SUPPLY 12/14-BIT VOUT DAC - Bulk |
| AD5382BST-3-REEL | 制造商:Analog Devices 功能描述:DAC 32-CH Resistor-String 14-bit 100-Pin LQFP T/R |
| AD5382BST-5 | 制造商:Analog Devices 功能描述:DAC 32-CH Resistor-String 14-bit 100-Pin LQFP 制造商:Rochester Electronics LLC 功能描述:32-CHN 5V SINGLE SUPPLY 14-BIT VOUT I.C. - Bulk |
| AD5382BST-5-REEL | 制造商:Analog Devices 功能描述:DAC 32-CH Resistor-String 14-bit 100-Pin LQFP T/R |
| AD5382BSTZ-3 | 功能描述:IC DAC 14BIT 32CHAN 3V 100LQFP RoHS:是 类别:集成电路 (IC) >> 数据采集 - 数模转换器 系列:- 产品培训模块:Lead (SnPb) Finish for COTS Obsolescence Mitigation Program 标准包装:1,000 系列:- 设置时间:1µs 位数:8 数据接口:串行 转换器数目:8 电压电源:双 ± 功率耗散（最大）:941mW 工作温度:0°C ~ 70°C 安装类型:表面贴装 封装/外壳:24-SOIC（0.295"，7.50mm 宽） 供应商设备封装:24-SOIC W 包装:带卷 (TR) 输出数目和类型:8 电压，单极 采样率（每秒）:* |
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