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参数资料
| 型号： | AD7767BRUZ-1 |
| 厂商： | Analog Devices Inc |
| 文件页数： | 23/25页 |
| 文件大小： | 0K |
| 描述： | ADC 24BIT 64KSPS SAR 16-TSSOP |
| 标准包装： | 1 |
| 位数： | 24 |
| 采样率（每秒）： | 64k |
| 数据接口： | 串行 |
| 转换器数目： | 1 |
| 功率耗散（最大）： | 18mW |
| 电压电源： | 模拟和数字 |
| 工作温度： | -40°C ~ 105°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 16-TSSOP（0.173"，4.40mm 宽） |
| 供应商设备封装： | 16-TSSOP |
| 包装： | 管件 |
| 输入数目和类型： | 1 个差分，单极 |
| 产品目录页面： | 779 (CN2011-ZH PDF) |
| 配用： | EVAL-AD7767EDZ-ND - BOARD EVAL AD7767 128KSPS 108DB EVAL-AD7767-1EDZ-ND - BOARD EVAL AD7767-1 64KSPS 111DB |
AD7767
Rev. C | Page 6 of
24
TIMING DIAGRAMS
MCLK
1
DRDY
t2
t3
t4
t1
tREAD
t5
tDRDY
8 × n
1
06
85
9-
0
02
Figure 2. DRDY vs. MCLK Timing Diagram, n = 1 for AD7767 (Decimate by 8), n = 2 for AD7767-1 (Decimate by 16), n = 4 for AD7767-2 (Decimate by 32)
06
85
9-
00
3
DRDY
CS
SCLK
SDO
tDRDY
tREAD
D22
MSB
D21
D20
D1
LSB
t6
t13
t12
1
23
t10
t11
t7
t8
t9
Figure 3. Serial Timing Diagram, Reading Data Using CS
06
85
9-
0
04
CS = 0
SCLK
SDO
DATA
INVALID
MSB
D22
D21
D20
D1
LSB
DATA
INVALID
DRDY
tDRDY
tREAD
1
23
24
t14
t8
t9
t15
t11
t10
Figure 4. Serial Timing Diagram, Reading Data Setting CS Logic Low
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PDF描述 |
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相关代理商/技术参数 |
参数描述 |
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