参数资料
型号: AD9520-2/PCBZ
厂商: Analog Devices Inc
文件页数: 18/80页
文件大小: 0K
描述: BOARD EVAL AD9520-2
设计资源: Synchronizing Multiple AD9910 1 GSPS Direct Digital Synthesizers (CN0121)
Phase Coherent FSK Modulator (CN0186)
AD9520 Eval Brd Schematic
AD9520 BOM
标准包装: 1
主要目的: 计时,时钟发生器
已用 IC / 零件: AD9520-2
已供物品:
Data Sheet
AD9520-2
Rev. A | Page 25 of 80
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1k
100M
1M
10M
100k
10k
PH
A
SE
N
O
ISE
(d
B
c
/H
z)
FREQUENCY (Hz)
07215-
033
NOTES
1. THE LOOP FILTER USED TO GENERATE THIS PLOT IS SHOWN IN FIGURE 41.
Figure 30. Phase Noise (Absolute) Clock Generation; Internal VCO at
2.212 GHz; PFD = 15.36 MHz; LBW = 66 kHz; LVPECL Output = 122.88 MHz
1k
100M
1M
10M
100k
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PH
A
SE
N
O
ISE
(d
B
c
/H
z)
FREQUENCY (Hz)
–120
–160
–150
–140
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07215-
135
Figure 31. Phase Noise (Absolute), External VCXO (Toyocom TCO-2112)
at 245.76 MHz; PFD = 15.36 MHz; LBW = 250 Hz; LVPECL Output = 245.76 MHz
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1k
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1M
10M
100k
10k
PH
A
SE
N
O
ISE
(d
B
c
/H
z)
FREQUENCY (Hz)
INTEGRATED RMS JITTER (12kHz TO 20MHz): 569fs
07215-
034
NOTES
1. THE LOOP FILTER USED TO GENERATE THIS PLOT IS SHOWN IN FIGURE 42.
Figure 32. Phase Noise (Absolute) Clock Cleanup; Internal VCO at 2.177 GHz;
PFD = 120 kHz; LBW = 2.18 kHz; LVPECL Output = 155.52 MHz
1000
100
10
1
0.1
0.01
0.1
1
10
100
1000
JITTER FREQUENCY (kHz)
OC-48 OBJECTIVE MASK
AD9520
fOBJ
07215-
134
NOTE: 375UI MAX AT 10Hz OFFSET IS THE
MAXIMUM JITTER THAT CAN BE
GENERATED BY THE TEST EQUIPMENT.
FAILURE POINT IS GREATER THAN 375UI.
IN
P
U
T
J
ITTE
R
A
M
P
LITU
D
E
(
U
Ip-
p)
Figure 33. Telcordia GR-253 Jitter Tolerance Plot
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PDF描述
AD9516-5/PCBZ BOARD EVAL FOR AD9516-5 2.5GHZ
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