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参数资料
| 型号： | AD9628BCPZ-105 |
| 厂商： | Analog Devices Inc |
| 文件页数： | 8/44页 |
| 文件大小： | 0K |
| 描述： | IC ADC DUAL 12BIT 64-LFCSP |
| 标准包装： | 1 |
| 位数： | 12 |
| 采样率（每秒）： | 105M |
| 数据接口： | LVDS，并联，串行，SPI |
| 转换器数目： | 2 |
| 电压电源： | 模拟和数字 |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 64-VFQFN 裸露焊盘，CSP |
| 供应商设备封装： | 64-LFCSP-VQ（9x9） |
| 包装： | 托盘 |
| 输入数目和类型： | 4 个单端，2 个差分 |
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AD9628
Rev. 0 | Page 16 of 44
Pin No.
Mnemonic
Type
Description
Digital Outputs
14
D0+ (LSB)
Output
Channel A/Channel B LVDS Output Data 0—True.
13
D0 (LSB)
Output
Channel A/Channel B LVDS Output Data 0—Complement.
16
D1+
Output
Channel A/Channel B LVDS Output Data 1—True.
15
D1
Output
Channel A/Channel B LVDS Output Data 1—Complement.
18
D2+
Output
Channel A/Channel B LVDS Output Data 2 —True.
17
D2
Output
Channel A/Channel B LVDS Output Data 2—Complement.
21
D3+
Output
Channel A/Channel B LVDS Output Data 3—True.
20
D3
Output
Channel A/Channel B LVDS Output Data 3—Complement.
23
D4+
Output
Channel A/Channel B LVDS Output Data 4—True.
22
D4
Output
Channel A/Channel B LVDS Output Data 4—Complement.
27
D5+
Output
Channel A/Channel B LVDS Output Data 5—True.
26
D5
Output
Channel A/Channel B LVDS Output Data 5—Complement.
30
D6+
Output
Channel A/Channel B LVDS Output Data 6—True.
29
D6
Output
Channel A/Channel B LVDS Output Data 6—Complement.
32
D7+
Output
Channel A/Channel B LVDS Output Data 7—True.
31
D7
Output
Channel A/Channel B LVDS Output Data 7—Complement.
34
D8+
Output
Channel A/Channel B LVDS Output Data 8—True.
33
D8
Output
Channel A/Channel B LVDS Output Data 8—Complement.
36
D9+
Output
Channel A/Channel B LVDS Output Data 9—True.
35
D9
Output
Channel A/Channel B LVDS Output Data 9—Complement.
39
D10+
Output
Channel A/Channel B LVDS Output Data 10—True.
38
D10
Output
Channel A/Channel B LVDS Output Data 10—Complement.
41
D11+ (MSB)
Output
Channel A/Channel B LVDS Output Data 11—True.
40
D11 (MSB)
Output
Channel A/Channel B LVDS Output Data 11—Complement.
43
OR+
Output
Channel A/Channel B LVDS Overrange Output—True.
42
OR
Output
Channel A/Channel B LVDS Overrange Output—Complement.
25
DCO+
Output
Channel A/Channel B LVDS Data Clock Output—True.
24
DCO
Output
Channel A/Channel B LVDS Data Clock Output—Complement.
SPI Control
45
SCLK/DFS
Input
SPI Serial Clock/Data Format Select Pin in External Pin Mode.
44
SDIO/DCS
Input/Output
SPI Serial Data I/O/Duty Cycle Stabilizer Pin in External Pin Mode.
46
CSB
Input
SPI Chip Select (Active Low).
ADC Configuration
47
OEB
Input
Output Enable Input (Active Low). Pin must be enabled via SPI.
48
PDWN
Input
Power-Down Input in External Pin Mode. In SPI mode, this input can be configured as
power-down or standby.
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