参数资料
| 型号： | AD9762ARZRL |
| 厂商： | Analog Devices Inc |
| 文件页数： | 2/23页 |
| 文件大小： | 0K |
| 描述： | IC DAC 12BIT 125MSPS 28-SOIC |
| 产品培训模块： | Data Converter Fundamentals DAC Architectures |
| 标准包装： | 1,000 |
| 系列： | TxDAC® |
| 设置时间： | 35ns |
| 位数： | 12 |
| 数据接口： | 并联 |
| 转换器数目： | 1 |
| 电压电源： | 模拟和数字 |
| 功率耗散（最大）： | 160mW |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 28-SOIC（0.295"，7.50mm 宽） |
| 供应商设备封装： | 28-SOIC W |
| 包装： | 带卷 (TR) |
| 输出数目和类型： | 2 电流，单极；2 电流，双极 |
| 采样率（每秒）： | 125M |
AD9762
–10–
REV. B
FREQUENCY – MSPS
dBc
–70
–75
–95
0
20
140
40
60
80
100
120
–80
–85
–90
2ND
HARMONIC
3RD
HARMONIC
4TH
HARMONIC
Figure 30. THD vs. fCLOCK @ fOUT =
2 MHz
1.25
–0.50
–1.25
4000
ERROR
–
LSB
1000
2000
3000
1.00
–0.25
0.25
0
–0.75
0.50
–1.00
0.75
CODE
0
Figure 33. Typical INL
10dB
–
Div
0
–100
START: 0.3 MHz
STOP: 50.0 MHz
fCLOCK = 100 MSPS
fOUT = 2.41MHz
SFDR = 72dBc
AMPLITUDE = 0dBFS
Figure 36. Single-Tone SFDR
IOUTFS – mA
SFDR
–
dBc
80
70
30
24
20
14
60
50
40
75
65
55
45
35
6
8
10
12
16
18
2.5MHz
10MHz
22.2MHz
40MHz
Figure 31. SFDR vs. fOUT and IOUTFS
@ 100 MSPS, 0 dBFS
1
–0.4
4000
ERROR
–
LSB
1000
2000
3000
0.8
–0.2
0.2
0
0.4
0.6
CODE
0
Figure 34. Typical DNL
10dB
–
Div
0
–100
START: 0.3 MHz
STOP: 50.0 MHz
fCLOCK = 100 MSPS
fOUT1 = 13.5MHz
fOUT2 = 14.5MHz
SFDR = 59.0dBc
AMPLITUDE = 0dBFS
Figure 37. Dual-Tone SFDR
OUTPUT FREQUENCY – MHz
SFDR
–
dBc
75
70
45
1
10
100
60
55
50
65
IDIFF @
–6dBFS
IDIFF @
0dBFS
IOUTA @
–6dBFS
IOUTA @
0dBFS
Figure 32. Differential vs. Single
Ended SFDR vs. fOUT @ 100 MSPS
TEMPERATURE – C
SFDR
–
dBc
80
75
50
–40
–20
80
60
70
65
60
55
40
20
0
2.5MHz
10MHz
28.6MHz
Figure 35. SFDR vs. Temperature
@ 100 MSPS, 0 dBFS
10dB
–
Div
–10
–110
START: 0.3 MHz
STOP: 25.0 MHz
fCLOCK = 50 MSPS
fOUT1 = 6.25MHz
fOUT2 = 6.75MHz
fOUT3 = 7.25MHz
fOUT4 = 7.75MHz
SFDR = 71dBc
AMPLITUDE = 0dBFS
Figure 38. Four-Tone SFDR
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