参数资料
型号: ADAU1328BSTZ-RL
厂商: Analog Devices Inc
文件页数: 14/32页
文件大小: 0K
描述: IC CODEC 24BIT 2ADC/8DAC 48LQFP
标准包装: 2,000
类型: 通用
数据接口: 串行
分辨率(位): 24 b
ADC / DAC 数量: 2 / 8
三角积分调变:
S/N 比,标准 ADC / DAC (db): 94 / 94
动态范围,标准 ADC / DAC (db): 105 / 106
电压 - 电源,模拟: 3 V ~ 3.6 V
电压 - 电源,数字: 3 V ~ 3.6 V
工作温度: -40°C ~ 85°C
安装类型: 表面贴装
封装/外壳: 48-LQFP
供应商设备封装: 48-LQFP(7x7)
包装: 带卷 (TR)
Data Sheet
ADAU1328
Rev. B | Page 21 of 32
ALRCLK
ABCLK
4 ADC CHANNELS OF
SECOND IC IN THE CHAIN
4 ADC CHANNELS OF
FIRST IC IN THE CHAIN
ADC L1
ADC R1
ADC L2
ADC R2
ADC L1
ADC R1
ADC L2
ADC R2
ASDATA1 (TDM_OUT
OF THE SECOND ADAU1328
IN THE CHAIN)
ADC L1
ADC R1
ADC L2
ADC R2
ASDATA2 (TDM_IN
OF THE SECOND ADAU1328
IN THE CHAIN)
32 BITS
MSB
DSP
SECOND
ADAU1328
FIRST
ADAU1328
06102-
057
Figure 22. Dual-Line ADC TDM Daisy-Chain Mode (512 fS ABCLK, Two ADAU1328 Daisy Chain)
LRCLK
BCLK
SDATA
LRCLK
BCLK
SDATA
LRCLK
BCLK
SDATA
LSB
LEFT CHANNEL
RIGHT CHANNEL
LEFT CHANNEL
RIGHT CHANNEL
MSB
RIGHT-JUSTIFIED MODE—SELECT NUMBER OF BITS PER CHANNEL
DSP MODE—16 BITS TO 24 BITS PER CHANNEL
I2S MODE—16 BITS TO 24 BITS PER CHANNEL
LEFT-JUSTIFIED MODE—16 BITS TO 24 BITS PER CHANNEL
LRCLK
BCLK
SDATA
LSB
NOTES
1. DSP MODE DOES NOT IDENTIFY CHANNEL.
2. LRCLK NORMALLY OPERATES AT
fS EXCEPT FOR DSP MODE, WHICH IS 2 × fS.
3. BCLK FREQUENCY IS NORMALLY 64 × LRCLK BUT MAY BE OPERATED IN BURST MODE.
MSB
1/
fS
06102-
013
Figure 23. Stereo Serial Modes
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PDF描述
CS4271-DZZR IC CODEC 24BIT 114DB 28-TSSOP
JL05-6A20-29S-R CONN PLUG 17POS W/SOCKET SOLDER
VI-J3R-IX-S CONVERTER MOD DC/DC 7.5V 75W
VI-J3N-IX-S CONVERTER MOD DC/DC 18.5V 75W
VI-J3M-IX-S CONVERTER MOD DC/DC 10V 75W
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参数描述
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