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参数资料
| 型号： | ADAU1328BSTZ-RL |
| 厂商： | Analog Devices Inc |
| 文件页数： | 17/32页 |
| 文件大小： | 0K |
| 描述： | IC CODEC 24BIT 2ADC/8DAC 48LQFP |
| 标准包装： | 2,000 |
| 类型： | 通用 |
| 数据接口： | 串行 |
| 分辨率（位）： | 24 b |
| ADC / DAC 数量： | 2 / 8 |
| 三角积分调变： | 是 |
| S/N 比，标准 ADC / DAC (db)： | 94 / 94 |
| 动态范围，标准 ADC / DAC (db)： | 105 / 106 |
| 电压 - 电源，模拟： | 3 V ~ 3.6 V |
| 电压 - 电源，数字： | 3 V ~ 3.6 V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 48-LQFP |
| 供应商设备封装： | 48-LQFP（7x7） |
| 包装： | 带卷 (TR) |
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ADAU1328
Data Sheet
Rev. B | Page 24 of 32
CONTROL REGISTERS
DEFINITIONS
The global address for the ADAU1328 is 0x04, shifted left 1 bit due to the R/W bit. All registers are reset to 0, except for the DAC volume
registers that are set to full volume.
Note that the first setting in each control register parameter is the default setting.
Table 13. Register Format
Global Address
R/W
Register Address
Data
Bit
23:17
16
15:8
7:0
Table 14. Register Addresses and Functions
Address
Function
0
PLL and Clock Control 0
1
PLL and Clock Control 1
2
DAC Control 0
3
DAC Control 1
4
DAC Control 2
5
DAC individual channel mutes
6
DAC 1L volume control
7
DAC 1R volume control
8
DAC 2L volume control
9
DAC 2R volume control
10
DAC 3L volume control
11
DAC 3R volume control
12
DAC 4L volume control
13
DAC 4R volume control
14
ADC Control 0
15
ADC Control 1
16
ADC Control 2
PLL AND CLOCK CONTROL REGISTERS
Table 15. PLL and Clock Control 0
Bit
Value
Function
Description
0
Normal operation
PLL power-down
1
Power-down
2:1
00
INPUT 256 (×44.1 kHz or 48 kHz)
MCLK pin functionality (PLL active)
01
INPUT 384 (×44.1 kHz or 48 kHz)
10
INPUT 512 (×44.1 kHz or 48 kHz)
11
INPUT 768 (×44.1 kHz or 48 kHz)
4:3
00
XTAL oscillator enabled
MCLKO pin
01
256 × fS VCO output
10
512 × fS VCO output
11
Off
6:5
00
MCLK
PLL input
01
DLRCLK
10
ALRCLK
11
Reserved
7
0
Disable: ADC and DAC idle
Internal MCLK enable
1
Enable: ADC and DAC active
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PDF描述 |
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