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参数资料
| 型号： | ADAU1381BCBZ-RL7 |
| 厂商： | Analog Devices Inc |
| 文件页数： | 44/84页 |
| 文件大小： | 0K |
| 描述： | IC AUDIO CODEC STEREO LN 30WLCSP |
| 标准包装： | 1 |
| 类型： | 立体声音频 |
| 数据接口： | 串行，SPI? |
| 分辨率（位）： | 24 b |
| ADC / DAC 数量： | 2 / 2 |
| 三角积分调变： | 无 |
| S/N 比，标准 ADC / DAC (db)： | 97 / 100 |
| 动态范围，标准 ADC / DAC (db)： | 96.5 / 100 |
| 电压 - 电源，模拟： | 1.8 V ~ 3.65 V |
| 电压 - 电源，数字： | 1.63 V ~ 3.65 V |
| 工作温度： | -25°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 30-UFBGA，WLCSP |
| 供应商设备封装： | 30-WLCSP（3.4x2.64） |
| 包装： | 标准包装 |
| 配用： | EVAL-ADAU1381Z-ND - BOARD EVALUATION FOR ADAU1381 |
| 其它名称： | ADAU1381BCBZ-RL7DKR |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页当前第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页
ADAU1381
Rev. B | Page 49 of 84
Register 16393 (0x4009), Record Power Management
This register manages the power consumption for the record
path. In particular, the current distribution for the mixer boosts,
ADC, front-end mixer, and PGAs can be set in one of four
modes. The four modes of operation available that affect the
performance of the device are normal operation, power saving,
enhanced performance, and extreme power saving. Normal
operation has a base current of 2.5 μA, enhanced performance
has a base current of 3 μA, power saving has a base current of
a 2 μA, and extreme power saving has a base current of 1.5 μA.
Enhanced performance offers the highest performance, but
with the trade-off of higher power consumption.
Bits[6:5], Mixer Amplifier Boost
These bits set the power mode of operation for the front-end
mixer boost. With higher AVDD1 levels, distortion may become
an issue affecting performance. Each boost level enhances the
THD + N performance at 3.3 V AVDD1.
Bits[4:3], ADC Bias Control
These bits set the bias current for the ADCs based on the mode
of operation selected.
Bits[2:1], Front-End Bias Control
These bits set the bias current for the PGAs and mixers in the
front-end record path.
Table 36. Record Power Management Register
Bits
Description
Default
7
Reserved
[6:5]
Mixer amplifier boost
00
00: normal operation
01: Boost Level 1
10: Boost Level 2
11: Boost Level 3
[4:3]
ADC bias control
00
00: normal operation
01: extreme power saving
10: power saving
11: enhanced performance
[2:1]
Front-end bias control
00
00: normal operation
01: extreme power saving
10: power saving
11: enhanced performance
0
Reserved
相关PDF资料 |
PDF描述 |
|---|---|
| ADAU1381BCBZ-RL | IC AUDIO CODEC STEREO LN 30WLCSP |
| VI-B3K-IW-B1 | CONVERTER MOD DC/DC 40V 100W |
| VI-B3H-IW-B1 | CONVERTER MOD DC/DC 52V 100W |
| VI-B3B-IW-B1 | CONVERTER MOD DC/DC 95V 100W |
| VE-J3B-IX-S | CONVERTER MOD DC/DC 95V 75W |
相关代理商/技术参数 |
参数描述 |
|---|---|
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